設(shè)計(jì)一個(gè)FIFO是FPGA設(shè)計(jì)者遇到的最普遍的問(wèn)題之一。本文著重介紹怎樣設(shè)計(jì)FIFO—— 這是一個(gè)看似簡(jiǎn)單卻很復(fù)雜的任務(wù)。 一開(kāi)始,要注意,F(xiàn)IFO通常用于時(shí)鐘域的過(guò)渡,是雙時(shí)鐘設(shè)計(jì)。換句話說(shuō),設(shè)計(jì)工程要處
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