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1553B總線(xiàn)協(xié)議

關(guān)注人關(guān)注

我要報(bào)錯(cuò)

基于1553B總線(xiàn)協(xié)議的解碼器設(shè)計(jì)和FPGA實(shí)現(xiàn)

摘要：文章通過(guò)對(duì)1553B總線(xiàn)協(xié)議的研究，結(jié)合現(xiàn)代EDA技術(shù)，介紹了一種使用現(xiàn)場(chǎng)可編程邏輯器件(FPGA)設(shè)計(jì)1553B,總線(xiàn)協(xié)議用的manches-ter II型碼解碼器的方法。通過(guò)采用Verilog HDL硬件描述語(yǔ)言和原理圖混合輸入法，使設(shè)

電子設(shè)計(jì)自動(dòng)化
2011-04-14

解碼器 FPGA實(shí)現(xiàn) 1553B總線(xiàn)協(xié)議 BSP

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