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提高編程技巧的十大方法

1.學(xué)習(xí)一門新的編程語言（Learn a new programming language）學(xué)習(xí)一門新的編程語言將有助于你開拓新的思維方式，特別是當(dāng)你使用不熟悉的語言時(shí)，你將學(xué)習(xí)到很多種思維方法應(yīng)用到語言中。而所學(xué)習(xí)到的新思維方式，

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2012-12-12

編程技巧代碼 BSP PROGRAMMING
為什么向后端工程師推薦Node.js

科普文一則，說說我對(duì)Node.js的一些認(rèn)識(shí)，以及我作為前端工程師為什么會(huì)向后端工程師推薦Node.js。 “Node.js 是服務(wù)器端的 JavaScript 運(yùn)行環(huán)境，它具有無阻塞(non-blocking)和事件驅(qū)動(dòng)(event-driven)等的特色

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2012-12-12

工程師 NODE.JS JAVASCRIPT BSP
單電源儀表放大器電路

儀表放大器將兩個(gè)信號(hào)的差值放大。典型的差模信號(hào)來自傳感器件,諸如電阻橋或熱電偶。圖1示出了儀表放大器的典型應(yīng)用,來自電阻橋的差模電壓被AD620(低功耗,低成本,集成儀表放大器)放大。在熱電偶和電阻橋的應(yīng)用中,差模

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2012-12-11

單電源儀表放大器放大器電路 BSP
DDS的工作原理

DDS的基本原理是利用采樣定理，通過查表法產(chǎn)生波形。DDS的結(jié)構(gòu)有很多種，其基本的電路原理可用圖3 來表示。相位累加器由N位加法器與N位累加寄存器級(jí)聯(lián)構(gòu)成。每來一個(gè)時(shí)鐘脈沖FS，加法器將頻率控制字K與累加寄存器輸

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2012-12-11

相位頻率控制加法器 DDS
全硅MEMS振蕩器介紹

無論是電子工程師還是元器件采購者，在選擇時(shí)鐘組件時(shí)都會(huì)經(jīng)過全面嚴(yán)謹(jǐn)?shù)脑u(píng)估。因?yàn)橐活w健康、穩(wěn)定、持久的“心臟”，將直接影響到電子系統(tǒng)的功能和可靠性。時(shí)鐘組件可分為無源晶振、有源晶振和多輸出時(shí)鐘

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2012-12-11

振蕩器 MEMS 頻率穩(wěn)定性 BSP
相位相干FSK調(diào)制器(CN0186)

電路功能與優(yōu)勢(shì)標(biāo)準(zhǔn)的單通道直接數(shù)字頻率合成器(DDS)不會(huì)以相位相干形式在不同頻率之間切換。根據(jù)設(shè)計(jì)，DDS頻率轉(zhuǎn)換具有“相位連續(xù)性”(如圖2所示)。不過，圖1所示電路展示了如何配置AD9958/AD9959 多通道

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2012-12-11

相位數(shù)據(jù)流 DDS FSK調(diào)制器
高可靠性飛行代碼的自動(dòng)化驗(yàn)證技術(shù)

從仿真模型自動(dòng)生成代碼是基于模型設(shè)計(jì)中的關(guān)鍵開發(fā)環(huán)節(jié)，可實(shí)質(zhì)性地減少開發(fā)團(tuán)隊(duì)手寫代碼所花費(fèi)的時(shí)間和工作量。要想成功開發(fā)高性能的嵌入式系統(tǒng)，就必須生成非常高效的代碼。代碼效率目標(biāo)包括內(nèi)存使用的最小化和執(zhí)

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2012-12-10

自動(dòng)化 CODE SIMULINK 代碼
模塊化/KSK 線束自動(dòng)化設(shè)計(jì)

為線束產(chǎn)品構(gòu)建超級(jí)數(shù)據(jù)集合是一種有效的常用方法。對(duì)線束制造商，尤其是今天的汽車行業(yè)來說，用電腦設(shè)計(jì)工具自動(dòng)為集合生成多個(gè)不同線束已經(jīng)很常見了。當(dāng)消費(fèi)者需求、新技術(shù)和新規(guī)定的影響開始導(dǎo)致配置管理難以控制

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2012-12-07

模塊化自動(dòng)化設(shè)計(jì) 代碼
利用低抖動(dòng)LVPECL扇出緩沖器增加時(shí)鐘源的輸出數(shù)

器件連接/參考 ADF4351：集成VCO的小數(shù)N分頻PLL合成器ADCLK948：提供8路LVPECL輸出的時(shí)鐘扇出緩沖器評(píng)估和設(shè)計(jì)支持電路評(píng)估板 ADF4351評(píng)估板(EVAL-ADF4351EB1Z)ADCLK948評(píng)估板(ADCLK948/PCBZ) 設(shè)計(jì)和集成文件原理

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2012-12-07

時(shí)鐘緩沖器 LVPECL BSP
基于全耗盡平面晶體管技術(shù)的NovaThor平臺(tái)設(shè)計(jì)

隨著智能手機(jī)功能最近不斷升級(jí)演化，消費(fèi)者的期望值日益攀升。速度更快的多核高主頻CPU處理器、令人震撼的3D圖形、全高清多媒體和高速寬帶現(xiàn)已成為高端手機(jī)的標(biāo)配。同時(shí)，消費(fèi)者還期望手機(jī)纖薄輕盈，電池續(xù)航能力至少

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2012-12-07

晶體管泄漏電流 HP NOVA
解析ADC不同類型數(shù)字輸出及挑戰(zhàn) — 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

ADC不同類型數(shù)字輸出深解在當(dāng)今的模數(shù)轉(zhuǎn)換器(ADC)領(lǐng)域，ADC制造商主要采用三類數(shù)字輸出。這三種輸出分別是：互補(bǔ)金屬氧化物半導(dǎo)體(CMOS)、低壓差分信號(hào)(LVDS)和電流模式邏輯(CML)。每類輸出均基于采樣速率、分辨率、

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2012-12-06

集成模數(shù)轉(zhuǎn)換器 ADC CMOS
ADC輸入轉(zhuǎn)換器電路分析 — 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

ADC輸入轉(zhuǎn)換器電路分析許多高精度模/數(shù)轉(zhuǎn)換器的輸入范圍要求介于0.0V至5.0V之間。例如，MAX1402 (18位多通道Σ-Δ ADC)測(cè)量兩個(gè)輸入之間的差值。典型的單端應(yīng)用中，該ADC將輸入電壓與固定的基準(zhǔn)電壓(例如2

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2012-12-06

模數(shù)轉(zhuǎn)換器電路分析 ADC PLUSMN
如何提高ADC性能 — 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

ADC性能提高的建議雖然ADC看起來非常簡單，但它們必須正確使用才能獲得最優(yōu)的性能。ADC具有與簡單模擬放大器相同的性能限制，比如有限增益、偏置電壓、共模輸入電壓限制和諧波失真等。ADC的采樣特性需要我們更多地考

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2012-12-06

模數(shù)轉(zhuǎn)換器模擬輸入 ADC 代碼
多種ADC的分析比較 — 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

多種ADC的分析比較A/D轉(zhuǎn)換技術(shù)現(xiàn)在的軟件無線電、數(shù)字圖像采集都需要有高速的A/D采樣保證有效性和精度，一般的測(cè)控系統(tǒng)也希望在精度上有所突破，人類數(shù)字化的浪潮推動(dòng)了A/D轉(zhuǎn)換器不斷變革，而A/D轉(zhuǎn)換器是人類實(shí)現(xiàn)數(shù)字

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2012-12-06

器件模數(shù)轉(zhuǎn)換器 ADC A/D轉(zhuǎn)換器
ADC關(guān)鍵性能指標(biāo)及誤區(qū) — 全方位學(xué)習(xí)模數(shù)轉(zhuǎn)換器(ADC)

ADC關(guān)鍵性能指標(biāo)及誤區(qū)由于ADC產(chǎn)品相對(duì)于網(wǎng)絡(luò)產(chǎn)品和服務(wù)器需求小很多，用戶和集成商在選擇產(chǎn)品時(shí)對(duì)關(guān)鍵指標(biāo)的理解難免有一些誤區(qū)，加之部分主流廠商刻意引導(dǎo)，招標(biāo)規(guī)范往往有不少非關(guān)鍵指標(biāo)作被作為必須符合項(xiàng)。接下

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2012-12-06

CPU 模數(shù)轉(zhuǎn)換器 ADC PS

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