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  • 一種減少VDMOS寄生電容的新結(jié)構(gòu)

    分析影響VDMOS開關(guān)特性的各部分電容結(jié)構(gòu)及參數(shù)，為了減少寄生電容，提高開關(guān)速度，在此提出一種減少VDMOS寄生電容的新型結(jié)構(gòu)。該方法是部分去除傳統(tǒng)VDMOS的neck區(qū)多晶硅條，并利用多晶硅作掩模注入P型區(qū)，改變VDMOS柵下耗盡區(qū)形狀，減小寄生電容。在此增加了neck區(qū)寬度，并增加了P阱注入。利用TCAD工具模擬，結(jié)果表明：這種新型結(jié)構(gòu)與傳統(tǒng)VDMOS相比，能有效減小器件的寄生電容，減少柵電荷量，提高開關(guān)時間，提高器件的動態(tài)性能。

    模擬
    2009-11-25
    電容 VDMOS BSP CIS

  • 八位競賽搶答器電子系統(tǒng)電路分析與設(shè)計

    設(shè)計一種實用的八位的競賽搶答器，為學(xué)習(xí)電子的人提供一種電路的分析和設(shè)計方法，采用了電路系統(tǒng)的分析方法對實用電子技術(shù)電路進行分析和設(shè)計，最終得出一種創(chuàng)新的應(yīng)用型電路。

  • 基于DSP Builder的16階FIR濾波器實現(xiàn)

    現(xiàn)場可編程門陣列(FPGA)器件廣泛用于數(shù)字信號處理領(lǐng)域．而使用VHDL或VerilogHDL語言進行設(shè)計的難度較大。提出一種采用DSP Builder實現(xiàn)FIR濾波器的設(shè)計方案，按照Matlab／Simulink／DSP Builder／Modelsim／QuartusⅡ的設(shè)計流程，設(shè)計一個16階的FIR低通濾波器，并完成了軟硬件的仿真與驗證。結(jié)果表明，該方法簡單易行，可滿足設(shè)計要求，它驗證了采用DSP Builder實現(xiàn)濾波器設(shè)計的獨特優(yōu)勢。

  • CCD相機系統(tǒng)中驅(qū)動電路的設(shè)計

    目前，線陣CCD圖像傳感器的種類很多，驅(qū)動時序的產(chǎn)生方法也是多種多樣。CCD時序驅(qū)動電路的設(shè)計是CCD應(yīng)用的關(guān)鍵，只有設(shè)計出符合要求的驅(qū)動時序，CCD器件才能穩(wěn)定可靠的工作。常用的驅(qū)動方法存在某些缺點。在詳細了解線陣CCD器件μPD795，分析其驅(qū)動時序與電路邏輯后，沒有使用常規(guī)方法，而是使用CPLD進行功能的實現(xiàn)。該方法采用CPLD產(chǎn)生驅(qū)動，按要求寫好VHDL代碼產(chǎn)生可執(zhí)行文件．通過JTAG接口下載到可編程器件中。實驗結(jié)果表明該電路穩(wěn)定可靠，在線陣CCD驅(qū)動電路中具有一定的代表性。

  • 為便攜式電子設(shè)備設(shè)計D類音頻放大器

    不同含義的效率　　D類音頻放大器最具吸引力的特性是高效率。音頻放大器的效率有多種含義不同的效率，傳統(tǒng)定義是輸出電功率與總輸入功率之比。對于音頻放大器，轉(zhuǎn)換為可聽聲音的電功率與總輸入功率之比需要最大，這引

  • 基于LabVIEW的多路時序控制脈沖發(fā)生器設(shè)計

    為了解決過程控制和自動化過程中時序控制的問題，較為詳細地介紹了基于LabVIEW和數(shù)據(jù)采集卡的虛擬脈沖信號產(chǎn)生方法，采用多路數(shù)字信號序列同步輸出的方式，設(shè)計并實現(xiàn)一種通用的多路時序控制脈沖信號發(fā)生器。相比于傳統(tǒng)的時序信號發(fā)生器，具有路數(shù)多，參數(shù)調(diào)節(jié)方便，精度較高，容易升級等特點。實際測試和應(yīng)用表明，可以廣泛應(yīng)用于各種過程控制和自動化過程中。

  • 基于NI Scope實時數(shù)據(jù)采集系統(tǒng)設(shè)計

    在LabVIEW開發(fā)環(huán)境下，為實時顯示數(shù)據(jù)采集結(jié)果，通過結(jié)合虛擬儀器的概念，采用IVI驅(qū)動程序NI Scope和隊列同步控制技術(shù)快速搭建實時數(shù)據(jù)采集系統(tǒng)。結(jié)果表明該系統(tǒng)可實現(xiàn)對模擬輸入信號的實時采集和數(shù)據(jù)顯示及可控制存儲等功能，效果較好。特別是使用圖形化編程語言，簡化代碼，操作方便，人機界面友好，可擴展性強。

  • 基于CPCI總線的智能A／D，D／A模塊設(shè)計

    A／D和D／A接口在工業(yè)控制應(yīng)用中普遍存在．這就促使了基于各種接口的A／D，D／A模塊的誕生?；贑PCI總線的A／D，D／A模塊通過CPCI總線與主機通信，通過A／D接口采集電壓信號，經(jīng)過伺服控制軟件處理，輸出模擬量驅(qū)動執(zhí)行機構(gòu)。該模塊使用DSP芯片對數(shù)據(jù)進行實時處理，通過CPCI總線進行快速的數(shù)據(jù)傳輸。在實際應(yīng)用中得到了可靠性、實時性等方面驗證。

  • 基于NCO IP core的Chirp函數(shù)實現(xiàn)設(shè)計

    首先分析Chirp函數(shù)在頻域上的一般特性，并且分析Altrea公司提供的數(shù)控振蕩器知識產(chǎn)權(quán)核(NCO IP core)的輸入／輸出特性，通過MegaCore環(huán)境確定其輸入控制字，通過外圍邏輯電路實時向NCO IP core調(diào)入控制頻率控制字以達到改變輸出頻率的目的，并通過在示波器上觀測FPGA的運行情況，驗證了該設(shè)計具有很好的輸出效果。

  • 基于磁放大器的ATX電源的設(shè)計

    1 ATX電源簡介 早期PC中的開關(guān)電源是AT電源的一統(tǒng)天下。AT電源的輸出功率一般為150～250W，共有四路輸出(+5V、-5V、+12V、-12V)，另外還向主板提供一個電源正常(PG，Power Good)信號。AT電源的缺點是采用切斷

  • 基于Matlab的交流斬波型PFC電路仿真研究

    為改善傳統(tǒng)功率因數(shù)校正電路的不足，提出一種新型交流斬波型單相功率因數(shù)校正電路的拓撲結(jié)構(gòu)，使開關(guān)管處于整流橋的交流側(cè)。該方案有助于提升電路的諧波抑制和功率因數(shù)校正能力，可實現(xiàn)單位功率因數(shù)，增強電路的電磁兼容性，降低電路的傳導(dǎo)損失。仿真結(jié)果表明，功率因數(shù)可達0．997，仿真結(jié)果驗證了方案的可行性和理論分析的正確性。

  • 一種自動變模控制的寬頻帶全數(shù)字鎖相環(huán)

    針對傳統(tǒng)的全數(shù)字鎖相環(huán)只能鎖定已知信號和鎖頻范圍較小的問題，提出了一種自動變模控制的寬頻帶全數(shù)字鎖相環(huán)。對比分析了各類全數(shù)字鎖相環(huán)鎖頻、鎖相的工作機理，提出了一種新的系統(tǒng)模型，重點研究了快速鎖定和頻帶拓寬的原理及實現(xiàn)方法。應(yīng)用EDA技術(shù)完成系統(tǒng)設(shè)計，并進行計算機仿真。仿真結(jié)果證實了該設(shè)計具有快的鎖定速度、寬的鎖頻范圍、并能快速跟蹤頻率突變的輸入信號。該鎖相環(huán)通用性強，易于集成，可作為IP核用于SoC的設(shè)計。

  • 基于MO-OTAS和CCCII電流模式通用濾波器

    提出一種采用跨導(dǎo)運算放大器MO-OTAS與電流傳送器CCCII相結(jié)合構(gòu)成的電流模式多功能濾波器，該電路由一個CCCII器件、二個MO-OTAS和三個接地電容所組成。在輸入端加入信號并將其與相應(yīng)的輸出端進行適當?shù)慕M合，即可得到低通、高通、帶通、帶阻和全通五種二階濾波器功能。所提出的電路中心頻率可調(diào)范圍大，中心頻率ω0和品質(zhì)因數(shù)Q獨立可調(diào)，無源元件全部接地，利于集成，產(chǎn)生的電路具有很低的靈敏度。理論分析和HSpice計算機仿真表明，提出的電路方案正確。

  • 基于在系統(tǒng)可編程模擬電路的聲發(fā)射前置電路設(shè)計

    1聲發(fā)射檢測系統(tǒng)　　聲發(fā)射技術(shù)是根據(jù)結(jié)構(gòu)內(nèi)部發(fā)出的應(yīng)力波，判斷結(jié)構(gòu)內(nèi)部損傷程度的一種有效的動態(tài)無損檢測技術(shù)?！　膶囕v懸掛系統(tǒng)進行動態(tài)無損檢測的要求出發(fā)，為了節(jié)約成本，我們自行研制了一套聲發(fā)射檢測系統(tǒng)

  • 超高速模數(shù)轉(zhuǎn)換器AD9224及其應(yīng)用

    1 引言 　　AD9224是美國AD公司生產(chǎn)的一種12位、40MSPS高性能模數(shù)轉(zhuǎn)換器。它具有片內(nèi)高性能采樣保持放大器和電壓參考。在單一＋5V電源下,它的功耗,僅有376mW,信噪比與失真度為±0．7dB。且具有信號溢出指示位,并可直

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