信號(hào)
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安立推出用于信號(hào)分析儀的GSM/EDGE軟件
MS269xA 信號(hào)分析儀超高速ACLR測(cè)量方法 當(dāng)頻譜分析儀進(jìn)行鄰信道泄露功率比（ACLR）與占用帶寬（OBW）測(cè)量時(shí)，作為常規(guī)的技術(shù)，平均化（Average功能）一般會(huì)被使用以獲得穩(wěn)定的測(cè)量結(jié)果。MS269xA信號(hào)分析儀利用捕獲（
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便攜式信號(hào)發(fā)生裝置和便攜式信號(hào)檢測(cè)裝置組成的系統(tǒng)設(shè)計(jì)
在室外的儀器使用中，經(jīng)常會(huì)遇到機(jī)器需要檢修的問題，但是實(shí)驗(yàn)室常用的示波器和信號(hào)發(fā)生器由于電源、體積等問題不便攜帶，這時(shí)就需要采用簡(jiǎn)易、便于攜帶的測(cè)試儀器。設(shè)計(jì)了一套基于嵌入式核心的由便攜
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信號(hào)整形電路的設(shè)計(jì)
最簡(jiǎn)單的信號(hào)整形電路就是一個(gè)單門限電壓比較器（如圖1 所示），當(dāng)輸入信號(hào)每通過一次零時(shí)觸發(fā)器的輸出就要產(chǎn)生一次突然的變化。當(dāng)輸入正弦波時(shí)，每過一次零，比較器的輸出端將產(chǎn)生一次電壓跳變，它的正負(fù)向幅度均受
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基于混合信號(hào)FPGA的智能型驗(yàn)證流程
為了因應(yīng)市場(chǎng)對(duì)于較高性能、較小的系統(tǒng)尺寸及降低成本和電源的需求，系統(tǒng)設(shè)計(jì)者正將較高層級(jí)的混合信號(hào)功能整合在他們的系統(tǒng)單芯片(SoC)設(shè)計(jì)中。隨著這些SoC設(shè)計(jì)上的混合信號(hào)組件數(shù)量增加了，基本的功能驗(yàn)證對(duì)于硅初
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雷達(dá)線性調(diào)頻信號(hào)在FPGA上的實(shí)現(xiàn)
線性調(diào)頻信號(hào)可以獲得較大的壓縮比，有著良好的距離分辨率和徑向速度分辨率，所以線性調(diào)頻信號(hào)作為雷達(dá)系統(tǒng)中一種常用的脈沖壓縮信號(hào)，已經(jīng)廣泛應(yīng)用于高分辨率雷達(dá)領(lǐng)域。直接數(shù)字頻率合成(Digital DirectFrequency S
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基于FPGA的VGA時(shí)序彩條信號(hào)設(shè)計(jì)實(shí)現(xiàn)
0 引 言 利用現(xiàn)場(chǎng)可編程邏輯器件產(chǎn)生VGA時(shí)序信號(hào)和彩條圖像信號(hào)，并將其作為信號(hào)源，應(yīng)用于電視機(jī)或計(jì)算機(jī)等彩色顯示器的電路開發(fā)，方便彩色顯示器驅(qū)動(dòng)控制電路的調(diào)試。計(jì)算機(jī)顯示器的顯示有許多標(biāo)準(zhǔn)，常見的有VGA，
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Android平臺(tái)下AOA協(xié)議的PWM信號(hào)控制系統(tǒng)
Android開放配件(AOA)協(xié)議是一種Android終端通過USB總線與Android配件進(jìn)行通信的協(xié)議，該協(xié)議為Android終端應(yīng)用于設(shè)備控制和數(shù)據(jù)采集領(lǐng)域提供了條件。在一些設(shè)備控制應(yīng)用中
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基于FPGA的AGWN信號(hào)生成器設(shè)計(jì)
在通信系統(tǒng)中分析計(jì)算系統(tǒng)抗噪聲性能時(shí)，經(jīng)常假定信道噪聲為加性高斯型白噪聲(AGWN)。本文就是通過分析AGWN的性質(zhì)，采用自頂向下的設(shè)計(jì)思路，將AGWN信號(hào)分成若干模塊，最終使用Verilog硬件描述語言，完成了通信系統(tǒng)中
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Actel推出世界首個(gè)智能型混合信號(hào)FPGA器件
愛特公司(Actel Corporation)宣布推出世界首個(gè)智能型混合信號(hào)FPGA器件SmartFusion，該產(chǎn)品現(xiàn)正投入批量生產(chǎn)。SmartFusion器件帶有Actel經(jīng)過驗(yàn)證的FPGA架構(gòu)，該架構(gòu)包括基于ARM Cortex-M3硬核處理器的完整微控制器子系
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Actel推出智能型混合信號(hào)FPGA器件SmartFusion
愛特公司(Actel Corporation)宣布推出世界首個(gè)智能型混合信號(hào)FPGA器件SmartFusion，該產(chǎn)品現(xiàn)正投入批量生產(chǎn)。SmartFusion器件帶有Actel經(jīng)過驗(yàn)證的FPGA架構(gòu)，該架構(gòu)包括基于ARM Cortex-M3硬核處理器的完整微控制器子系
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愛特發(fā)布SmartFusion智能混合信號(hào)FPGA的完整開發(fā)套件
愛特公司(Actel)宣布，公司已經(jīng)提供應(yīng)用于新近推出之SmartFusion智能混合信號(hào)現(xiàn)場(chǎng)可編程門陣列(FPGA)的完備易用的開發(fā)環(huán)境。這一廣泛的生態(tài)系統(tǒng)包含內(nèi)嵌有Synopsys公司Synplify Pro和Identify及Mentor Graphics公司M
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VHDL設(shè)計(jì)中信號(hào)與變量問題的研究
摘 要： 在設(shè)計(jì)過程中，如果信號(hào)和變量的定義不合適的話，設(shè)計(jì)結(jié)果完全不一樣，因此在設(shè)計(jì)過程中需要謹(jǐn)慎使用信號(hào)和變量。 在VHDL程序設(shè)計(jì)中，可以充分利用信號(hào)或變量的系統(tǒng)默認(rèn)值，來靈活實(shí)現(xiàn)設(shè)計(jì)目標(biāo)。本文從應(yīng)用
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用混合信號(hào)FPGA控制電壓攀升率
隨著工藝尺度不斷縮小，器件常常需要多個(gè)電源。為了減小功耗和最大限度地提高性能，器件的核心部分一般趨向于在低電壓下工作。為了與傳統(tǒng)的器件接口，或與現(xiàn)有的I/O標(biāo)準(zhǔn)配合，I/O接口的工作電平往往與核心部分不同，
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基于FPGA及模擬電路的模擬信號(hào)波形的實(shí)現(xiàn)
1 引言 波形發(fā)生器已經(jīng)廣泛的應(yīng)用在通信、控制、測(cè)量等各個(gè)領(lǐng)域，如鋸齒波、正弦波、方波等波形常用于電路的設(shè)計(jì)與調(diào)試。隨著電子技術(shù)的迅猛發(fā)展，數(shù)字化正逐漸地成為電子產(chǎn)業(yè)的發(fā)展趨勢(shì)，各公司都將自己的產(chǎn)品向數(shù)字
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FPGA技術(shù)在雷達(dá)信號(hào)模擬器中的應(yīng)用
摘 要： 基于FPGA的各種雷達(dá)信號(hào)產(chǎn)生方法，介紹了在FPGA中實(shí)現(xiàn)直接數(shù)字頻率合成器(DDS)以及提高輸出信號(hào)質(zhì)量的方法，編程實(shí)現(xiàn)了頻率捷變、線性調(diào)頻以及相位編碼等雷達(dá)信號(hào)的產(chǎn)生。仿真結(jié)果表明，該方法能靈活地產(chǎn)生
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基于混合信號(hào)FPGA的功率管理解決方案
概述 Actel Fusion? 混合信號(hào)FPGA能夠?qū)崿F(xiàn)功率管理，包括上電順序、運(yùn)行時(shí)間功率監(jiān)控，以及關(guān)機(jī)控制。此外，愛特公司提供的混合信號(hào)功率管理工具(Mixed-Signal Power Manager, MPM)參考設(shè)計(jì)，更可在如AFS090的小型F
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一種基于CPLD的聲發(fā)射信號(hào)傳輸系統(tǒng)設(shè)計(jì)
聲發(fā)射技術(shù)是光纖傳感技術(shù)和聲發(fā)射技術(shù)相結(jié)合的產(chǎn)物，是目前聲發(fā)射技術(shù)的發(fā)展趨勢(shì)。它將高靈敏度聲發(fā)射傳感器安裝于受力構(gòu)件表面以形成一定數(shù)目的傳感器陣列，實(shí)時(shí)接收和采集來自于材料缺陷的聲發(fā)射信號(hào)，進(jìn)而通過對(duì)
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如何找到在嵌入式設(shè)計(jì)中調(diào)試混合信號(hào)的正確方式？
當(dāng)今的工程師在面臨微、模數(shù)轉(zhuǎn)換器(ADC) 和(DAC) 等等集成電路帶來了獨(dú)特的測(cè)量挑戰(zhàn)中，有時(shí)需要解碼兩個(gè)IC 之間的SPI ，同時(shí)在同一塊系統(tǒng)電路板上觀察ADC 的輸入和輸出。在
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基于FPGA的語音信號(hào)實(shí)時(shí)處理
隨著語音識(shí)別技術(shù)的應(yīng)用越來越廣， 對(duì)其實(shí)時(shí)性的要求也越來越高。專用的DSP 語音芯片雖然有硬件加速功能， 但其指令依然是串行計(jì)算， 在實(shí)時(shí)性方面有所欠缺。如今， 具有并行運(yùn)算能力的FPGA 主頻不斷提高，加上其設(shè)
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使用邏輯分析儀時(shí)如何防止reg_wire型信號(hào)被優(yōu)化掉
隨著FPGA設(shè)計(jì)復(fù)雜程度越來越高，芯片內(nèi)部邏輯分析功能顯得越來越重要。硬件層次上的邏輯分析儀價(jià)格十分昂貴，而且操作比較復(fù)雜。目前，F(xiàn)PGA芯片的兩大供應(yīng)商都為自己的FPGA芯片提供了軟件層面上的邏輯分
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