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EDA技術(shù)進(jìn)行數(shù)字電路設(shè)計(jì)
隨著科學(xué)研究與技術(shù)開(kāi)發(fā)市場(chǎng)化，采用傳統(tǒng)電子設(shè)計(jì)手段在較短時(shí)間內(nèi)完成復(fù)雜電子系統(tǒng)設(shè)計(jì)，已經(jīng)越來(lái)越難完成了。EDA(Electronics Design Automation)技術(shù)是隨著集成電路和計(jì)
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基于單片機(jī)的復(fù)雜可編程邏輯器件快速配置方法
摘要：介紹基于SRAM的可重配置CPLD的原理，通過(guò)對(duì)多種串行配置的比較，提出了由單片機(jī)和FLASH存儲(chǔ)器組成的串行配置方式，并從系統(tǒng)復(fù)雜度、可靠性和經(jīng)濟(jì)性等方面進(jìn)行了比較和分析。 關(guān)鍵詞：復(fù)雜可編程邏輯器件 靜態(tài)
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關(guān)于電子信息技術(shù)中信號(hào)源的設(shè)計(jì)與制作
隨著科學(xué)技術(shù)的不斷發(fā)展，網(wǎng)絡(luò)電子設(shè)備得到普及，在電子時(shí)代中，電子信息技術(shù)在我們?nèi)粘Ｉ钪邪l(fā)揮的作用越來(lái)越重要，而信號(hào)源等基本電子設(shè)備發(fā)揮的作用也逐漸受到人們的重視。本文基于增強(qiáng)信息源功能性及實(shí)用性的原則，通過(guò)研究DDS技術(shù)重新定義和分析信息源的設(shè)計(jì)和制作方法。
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基于實(shí)驗(yàn)系統(tǒng)采用電路可動(dòng)態(tài)重組的設(shè)計(jì)方案
設(shè)計(jì)了一種基于單片機(jī)和可編程邏輯器件的模式化綜合實(shí)驗(yàn)系統(tǒng)。該實(shí)驗(yàn)系統(tǒng)采用電路可動(dòng)態(tài)重組的設(shè)計(jì)方案，在一套實(shí)驗(yàn)系統(tǒng)上既可同時(shí)滿(mǎn)足“數(shù)字電路與邏輯設(shè)計(jì)”、“可編程邏輯器件與應(yīng)用”、“單片機(jī)原理與應(yīng)用”三門(mén)課程的教學(xué)需要，也能完成綜合性設(shè)計(jì)項(xiàng)目。該實(shí)驗(yàn)系統(tǒng)共8個(gè)模式，預(yù)留擴(kuò)展接口，且EDA核心板和單片機(jī)均可根據(jù)實(shí)際需要進(jìn)行更換。綜合實(shí)驗(yàn)系統(tǒng)使用方便、靈活、可升級(jí)性好。在實(shí)驗(yàn)教學(xué)中學(xué)生反映良好，極大地提升了教學(xué)效果。
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EDA技術(shù)進(jìn)行數(shù)字電路設(shè)計(jì)
隨著科學(xué)研究與技術(shù)開(kāi)發(fā)市場(chǎng)化，采用傳統(tǒng)電子設(shè)計(jì)手段在較短時(shí)間內(nèi)完成復(fù)雜電子系統(tǒng)設(shè)計(jì)，已經(jīng)越來(lái)越難完成了。EDA(Electronics Design Automation)技術(shù)是隨著集成電路和計(jì)算機(jī)技術(shù)飛速發(fā)展應(yīng)運(yùn)而生一種高級(jí)、快速、
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航天科工304所開(kāi)展國(guó)內(nèi)首批可編程邏輯器件國(guó)軍標(biāo)制定工作
日前，航天科工304所承擔(dān)的國(guó)內(nèi)首批3項(xiàng)可編程邏輯器件總裝軍用標(biāo)準(zhǔn)(國(guó)軍標(biāo))制定工作取得階段性成果。該標(biāo)準(zhǔn)體系可基本滿(mǎn)足可編程邏輯器件研制的管理和技術(shù)要求，將填補(bǔ)軍工領(lǐng)域可編程邏輯器件領(lǐng)域空白。 三項(xiàng)國(guó)軍標(biāo)分
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航天科工304所開(kāi)展國(guó)內(nèi)首批可編程邏輯器件國(guó)軍標(biāo)制定工作
21ic訊 日前，航天科工304所承擔(dān)的國(guó)內(nèi)首批3項(xiàng)可編程邏輯器件總裝軍用標(biāo)準(zhǔn)(國(guó)軍標(biāo))制定工作取得階段性成果。該標(biāo)準(zhǔn)體系可基本滿(mǎn)足可編程邏輯器件研制的管理和技術(shù)要求，將填補(bǔ)軍工領(lǐng)域可編程邏輯器件領(lǐng)域空白。三項(xiàng)國(guó)
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Mouser推出全新可編程邏輯技術(shù)網(wǎng)站
Mouser Electronics宣布在Mouser.com上推出其最新的技術(shù)網(wǎng)站，專(zhuān)注于可編程邏輯技術(shù)。 該全新網(wǎng)站有助于工程師了解有關(guān)不同類(lèi)型可編程邏輯技術(shù)的更多信息和識(shí)別適用于特定應(yīng)用的理想元器件?？删幊踢壿嬈骷?PLD)各不
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可編程邏輯器件的應(yīng)用參考
引言隨著大規(guī)模超大規(guī)模可編程邏輯器件的發(fā)展，邏輯器件日益以其低廉的價(jià)格及靈活的設(shè)計(jì)方式、豐富完備的功能而廣泛應(yīng)用于電子線(xiàn)路設(shè)計(jì)中。采用CPLD可對(duì)邏輯電路功能進(jìn)行綜合集成，根據(jù)需要設(shè)計(jì)最小的單元，節(jié)約系統(tǒng)
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可編程邏輯器件接地設(shè)計(jì)
信號(hào)接地處理和地線(xiàn)設(shè)計(jì)也是高速FPGA設(shè)計(jì)的一部分，設(shè)計(jì)一個(gè)好的接地系統(tǒng)非常重要。接地的方法可以歸納為3種，即單點(diǎn)接地、多點(diǎn)接地和復(fù)合式接地。接地的類(lèi)型分為模擬地和數(shù)字地等。(1)單點(diǎn)接地單點(diǎn)接地是指在電路設(shè)
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基于可編程邏輯器件與單片機(jī)的雙控制器的設(shè)計(jì)
在傳統(tǒng)的控制系統(tǒng)中，人們常常采用單片機(jī)作為控制核心。但這種方法硬件連線(xiàn)復(fù)雜，可靠性差，且單片機(jī)的端口數(shù)目、內(nèi)部定時(shí)器和中斷源的個(gè)數(shù)都有限，在實(shí)際應(yīng)用中往往需要外加擴(kuò)展芯片。這無(wú)疑對(duì)系統(tǒng)的設(shè)計(jì)帶來(lái)諸多不
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Lattice持續(xù)優(yōu)化FPGA成本和功耗 迎接市場(chǎng)競(jìng)爭(zhēng)
本文主要是Lattice公司市場(chǎng)總監(jiān)Shakeel Peera給大家談面對(duì)競(jìng)爭(zhēng)激烈的FPGA市場(chǎng)，Lattice公司將持續(xù)優(yōu)化FPGA成本和功耗。Shakeel Peera表示，我們的目標(biāo)是能夠提供低成本、低功耗的可編程邏輯器件，且優(yōu)于該行業(yè)中的其
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固定邏輯與可編程邏輯PLD的區(qū)別
邏輯器件可分類(lèi)兩大類(lèi) - 固定邏輯器件和可編程邏輯器件。一如其名,固定邏輯器件中的電路是永久性的,它們完成一種或一組功能 -- 一旦制造完成,就無(wú)法改變。另一方面,可編程邏輯器件（PLD）是能夠?yàn)榭蛻?hù)提供范圍廣泛的
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開(kāi)源硬件：極客們的偉大理想
自 Dennis Allison 在 1975 年發(fā)布它的 Tiny BASIC 以來(lái)，他倡導(dǎo)的開(kāi)放、共享的思想得到了多數(shù)開(kāi)發(fā)者的認(rèn)同，這些年，軟件開(kāi)源取得了令人矚目的成績(jī)。同時(shí)，他那句 “讓我們站在彼此的肩膀，而不是彼此的腳趾上
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開(kāi)源硬件：極客們的偉大理想
開(kāi)源硬件：極客們的偉大理想
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可編程邏輯器件在高準(zhǔn)確度A／D轉(zhuǎn)換器中的應(yīng)用
1 引 言可編程邏輯器件（PLD）是當(dāng)今國(guó)際上流行的新一代數(shù)字系統(tǒng)邏輯器件。它主要是一種“與－或”兩級(jí)式結(jié)構(gòu)器件，除了具有高速度、高集成度性能之外，其最大的特點(diǎn)就是用戶(hù)可定義其邏輯功能。因此PLD能
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簡(jiǎn)析PLD的分類(lèi)及其優(yōu)點(diǎn)
本文主要描述可編程邏輯器件的類(lèi)型及其優(yōu)點(diǎn)，希望能給初學(xué)者們一點(diǎn)幫助?？删幊踢壿嬈骷挠⑽娜Q(chēng)為：programmable logic device 即PLD。PLD是做為一種通用集成電路產(chǎn)生的，它的邏輯功能按照用戶(hù)對(duì)器件編程來(lái)確定。
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基于CPLD的數(shù)字電路設(shè)計(jì)
0 引 言 可編程邏輯器件PLD(Programmable Logic De-vice)是一種數(shù)字電路，它可以由用戶(hù)來(lái)進(jìn)行編程和進(jìn)行配置，利用它可以解決不同的邏輯設(shè)計(jì)問(wèn)題。PLD由基本邏輯門(mén)電路、觸發(fā)器以及內(nèi)部連接電路構(gòu)成，利用軟件和硬
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使用嵌入式處理器對(duì)可編程邏輯器件重編程
使用嵌入式處理器對(duì)可編程邏輯器件重編程
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可編程邏輯器件的設(shè)計(jì)過(guò)程
可編程邏輯器件的設(shè)計(jì)流程如圖10-2所示，它主要包括設(shè)計(jì)準(zhǔn)備、設(shè)計(jì)輸入、設(shè)計(jì)處理和器件編程四個(gè)步驟，同時(shí)包括相應(yīng)的功能仿真、時(shí)序仿真和器件測(cè)試三個(gè)設(shè)計(jì)驗(yàn)證過(guò)程。 1.設(shè)計(jì)準(zhǔn)備采用有效的設(shè)計(jì)方案是PLD設(shè)計(jì)成功的
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