FIFO

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基于TMS320C50的通用語音信號(hào)處理系統(tǒng)

介紹了一個(gè)完整的基于PC機(jī)和DSP（TMS320C50）的通用語音信號(hào)處理系統(tǒng)。該系統(tǒng)通過編程設(shè)計(jì)可實(shí)現(xiàn)不同的語音信號(hào)分析和處理算法,能針對(duì)不同的應(yīng)用和新的處理方法,不斷添加DSP程序模塊,以此來改進(jìn)和擴(kuò)充系統(tǒng)的功能。

數(shù)字電源
2008-05-26

語音信號(hào)處理系統(tǒng) TMS320C FIFO BSP
應(yīng)用PCI 9656的數(shù)據(jù)接收卡設(shè)計(jì)

文章簡(jiǎn)述了PCI 9656的主要功能，介紹了一種應(yīng)用PCI 9656的CompactPCI數(shù)據(jù)接收卡設(shè)計(jì)。設(shè)計(jì)中采用MAXII系列CPLD建立了PCI 9656與FIFO間的數(shù)據(jù)通道，可滿足高速數(shù)據(jù)傳輸?shù)囊蟆?/p>
通信技術(shù)
2008-05-06

PCI 數(shù)據(jù)接收 COMPACTPCI FIFO
FPGA中軟FIFO設(shè)計(jì)和實(shí)現(xiàn)

異步FIFO是一種在電子系統(tǒng)中得到廣泛應(yīng)用的器件，文中介紹了一種基于FPGA的異步FIFO設(shè)計(jì)方法。使用這種方法可以設(shè)計(jì)出高速、高可靠的異步FIFO。

電子設(shè)計(jì)自動(dòng)化
2008-04-28

FPGA SPARTAN FIFO BSP
FPGA中軟FIFO設(shè)計(jì)和實(shí)現(xiàn)

異步FIFO是一種在電子系統(tǒng)中得到廣泛應(yīng)用的器件，文中介紹了一種基于FPGA的異步FIFO設(shè)計(jì)方法。使用這種方法可以設(shè)計(jì)出高速、高可靠的異步FIFO。

數(shù)字電源
2008-04-25

FPGA SPARTAN FIFO BSP
基于FPGA的基音檢測(cè)算法的設(shè)計(jì)與實(shí)現(xiàn)

將FPGA應(yīng)用在數(shù)字信號(hào)處理的主流技術(shù)DSP中是Altera推廣的重要應(yīng)用之一，本文依據(jù)Altera提出的基于FPGA的DSP解決方案，按照面向系統(tǒng)級(jí)和算法級(jí)的硬件設(shè)計(jì)思路

電子設(shè)計(jì)自動(dòng)化
2008-04-14

FPGA BUILDER FIFO BSP
基于FPGA的基音檢測(cè)算法的設(shè)計(jì)與實(shí)現(xiàn)

將FPGA應(yīng)用在數(shù)字信號(hào)處理的主流技術(shù)DSP中是Altera推廣的重要應(yīng)用之一，本文依據(jù)Altera提出的基于FPGA的DSP解決方案，按照面向系統(tǒng)級(jí)和算法級(jí)的硬件設(shè)計(jì)思路

數(shù)字電源
2008-04-11

FPGA BUILDER FIFO BSP
基于FPGA的基音檢測(cè)算法的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的基音檢測(cè)算法的設(shè)計(jì)與實(shí)現(xiàn)

嵌入式軟件
2008-04-11

FPGA BUILDER FIFO BSP
一種基于A／D和DSP的高速數(shù)據(jù)采集技術(shù)

本文介紹一種基于A/D和DSP的中頻信號(hào)采集技術(shù)；給出數(shù)據(jù)采集系統(tǒng)的原理和框圖，并對(duì)A／D與DSP的接口電路進(jìn)行分析。用FIFO作為兩者之間的接口效果很好；DSP通過CPLD對(duì)采樣時(shí)序進(jìn)行控制，可增強(qiáng)系統(tǒng)的靈活性。

單片機(jī)
2008-03-07

DSP 電平高速數(shù)據(jù)采集 FIFO
一種基于A／D和DSP的高速數(shù)據(jù)采集技術(shù)

本文介紹一種基于A/D和DSP的中頻信號(hào)采集技術(shù)；給出數(shù)據(jù)采集系統(tǒng)的原理和框圖，并對(duì)A／D與DSP的接口電路進(jìn)行分析。用FIFO作為兩者之間的接口效果很好；DSP通過CPLD對(duì)采樣時(shí)序進(jìn)行控制，可增強(qiáng)系統(tǒng)的靈活性。

數(shù)字電源
2008-03-05

DSP 電平高速數(shù)據(jù)采集 FIFO
基于SRAM和DRAM結(jié)構(gòu)的大容量FIFO的設(shè)計(jì)

分別基于Hynix公司的SRAM HY64UDl6322A和DRAM HY57V281620E，介紹了采用兩種不同的RAM結(jié)構(gòu)，通過CPLD來設(shè)計(jì)并實(shí)現(xiàn)大容量FIFO的方法。

智能硬件
2008-02-28

DRAM SRAM FIFO BSP
用FIFO實(shí)現(xiàn)A／D與ARM處理器的接口

介紹如何利用FIFO芯片CY7C4255V實(shí)現(xiàn)高速高精度模／數(shù)轉(zhuǎn)換器AD767l與LPC2200系列ARM處理器的接口。

智能硬件
2007-11-06

接口 ARM處理器 FIFO BSP

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FIFO

基于TMS320C50的通用語音信號(hào)處理系統(tǒng)

應(yīng)用PCI 9656的數(shù)據(jù)接收卡設(shè)計(jì)

FPGA中軟FIFO設(shè)計(jì)和實(shí)現(xiàn)

FPGA中軟FIFO設(shè)計(jì)和實(shí)現(xiàn)

基于FPGA的基音檢測(cè)算法的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的基音檢測(cè)算法的設(shè)計(jì)與實(shí)現(xiàn)

基于FPGA的基音檢測(cè)算法的設(shè)計(jì)與實(shí)現(xiàn)

一種基于A／D和DSP的高速數(shù)據(jù)采集技術(shù)

一種基于A／D和DSP的高速數(shù)據(jù)采集技術(shù)

基于SRAM和DRAM結(jié)構(gòu)的大容量FIFO的設(shè)計(jì)

用FIFO實(shí)現(xiàn)A／D與ARM處理器的接口

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