ZYNQ7000 互聯(lián)功能詳細介紹
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Zynq-7000 SoC器件使用了多種互聯(lián)技術,這些技術針對特定的應用進行了優(yōu)化,可以滿足很多功能塊的通信需求。
Zynq-7000 SoC概述
下圖描述了Zynq-7000 SoC的功能塊,PS和PL位于不同的位置電源域,使這些設備的用戶可以關閉PL的電源以進行電源管理。
需要注意的是:
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圖中箭頭方向顯示控制權(quán)(主機到從機)
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雙向數(shù)據(jù)流:AXI 32位/ 64位,AXI 64位,AXI 32位,AHB 32位,APB 32位,是可以自定義的
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APU中的灰色塊適用于雙核設備。
互聯(lián)模塊的框圖
本部分討論了所有互聯(lián)模塊的框圖,包括互聯(lián)模塊主模塊,監(jiān)聽控制單元,中央互聯(lián),主互聯(lián),從互聯(lián),內(nèi)存互聯(lián)和OCM互聯(lián)。
互聯(lián)主模塊
互聯(lián)主模塊包括:
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CPU和加速器一致性端口(ACP)
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高性能PL接口AXI_HP {3:0}
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通用PL接口AXI_GP {1:0}
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DMA控制器
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AHB主站(具有本地DMA單元的I / O外設)
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設備配置(DevC)和調(diào)試訪問端口(DAP)
監(jiān)聽控制單元(SCU)
探聽控制單元的功能在第3章“應用程序處理單元”中進行了描述。從SCU的角度來看,SCU的地址過濾功能使SCU的功能像一個開關,從其AXI從端口到其AXI主端口的流量。
中央互聯(lián)
中央互聯(lián)是基于ARM NIC301的互聯(lián)交換機的核心。
主互聯(lián)
主互聯(lián)將中速通信從中央互聯(lián)切換到M_AXI_GP端口,I/O外設(IOP)和其他模塊。
從站互聯(lián)
從互聯(lián)可從S_AXI_GP端口,DevC和DAP到中央互聯(lián)。
內(nèi)存互聯(lián)
存儲器互聯(lián)將高速流量從AXI_HP端口切換到DDR DRAM和片上RAM(通過另一個互連)。
OCM互聯(lián)
OCM互連從中央互連和內(nèi)存切換高速流量相互聯(lián)系
Interconnect Block Diagram
基于AXI高性能數(shù)據(jù)路徑的PS互聯(lián)開關
OCM互聯(lián)
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提供從中央互聯(lián)和PL訪問256 KB內(nèi)存的權(quán)限
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CPU和ACP接口通過SCU對OCM的訪問延遲最低
中央互聯(lián)
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中央互聯(lián)為64位,將IOP和DMA控制器連接到DDR存儲器控制器,片上RAM和AXI_GP接口(通過它們的開關)用于PL邏輯
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將以太網(wǎng),USB和SD / SDIO控制器中的本地DMA單元連接到中央相互聯(lián)系
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將PS中的主機連接到IOP
PS-PL接口說明
PS-PL接口
包含PL設計人員可用于集成基于PL的所有信號功能和PS。PL和PS之間有兩種類型的接口。
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功能接口,包括AXI互聯(lián),大多數(shù)擴展MIO接口(EMIO)I/O外設,中斷,DMA流控制,時鐘和調(diào)試接口。這些信號可用于連接PL中用戶設計的IP模塊。
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配置信號,包括處理器配置訪問端口(PCAP),配置狀態(tài),單事件失敗(SEU)和“程序/完成/初始化”。這些信號是連接到PL配置塊內(nèi)的固定邏輯,提供PS控制。
AXI功能接口
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AXI_ACP
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APU中的一個64位高速緩存一致性從端口連接到PL主端口
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連接到偵聽控制單元,以實現(xiàn)CPU和PL之間的高速緩存一致性
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AXI_HP,PS AXI互聯(lián)上的四個高性能/帶寬主端口
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32位或64位數(shù)據(jù)主接口(獨立編程)
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在32位從站接口配置模式下有效調(diào)整大小
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有效升至64位,以便在32位從接口中進行對齊的32位傳輸配置模式
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在32位從接口中自動擴展到64位以實現(xiàn)未對齊的32位傳輸配置模式
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32位和64位接口之間的動態(tài)命令升遷轉(zhuǎn)換,可控通過AxCACHE
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分別具有讀寫命令的R / W可編程發(fā)布功能
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寫入命令的可編程釋放閾值
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PL和PS之間所有AXI接口的異步時鐘頻域交叉
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使用1 KB(128 x 64位)數(shù)據(jù)FIFO平滑處理“長延遲”傳輸讀寫
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PL端口可提供QoS信令
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PL可使用的命令和數(shù)據(jù)FIFO填充級別計數(shù)
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支持標準AXI 3.0接口
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較大的從接口讀取接受能力,范圍為14到70個命令(突發(fā))取決于長度)
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較大的從接口寫接受能力,范圍為8到32個命令(突發(fā))取決于長度)
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AXI_GP,四個通用端口
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兩個32位主接口
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兩個32位從接口
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PL和PS之間所有AXI接口的異步時鐘頻域交叉
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支持標準AXI 3.0接口





