分頻器
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基于FPGA的雙模前置小數(shù)分頻器的設(shè)計(jì)
基于FPGA的雙模前置小數(shù)分頻器的設(shè)計(jì)
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淺析常見(jiàn)的分頻器問(wèn)題
分頻器是一種可以將聲音信號(hào)分成若干個(gè)頻段的音響設(shè)備。我們知道，聲音的頻率范圍是在20Hz—20kHz之間，祈望僅使用一只揚(yáng)聲器就能夠保證放送、20Hz—20kHz這樣寬頻率的聲音是很難做到的，因?yàn)檫@會(huì)在技術(shù)上
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業(yè)余的分頻器制作方法
高保真的音箱多數(shù)都是由兩只或兩只以上的揚(yáng)聲器單元構(gòu)成，要高質(zhì)量的還原20Hz～20kHz全頻段的音頻信號(hào)，必須借助優(yōu)質(zhì)分頻器的協(xié)助。由于各自音箱的揚(yáng)聲器單元不同，分頻器也就不能簡(jiǎn)單的代用，必須按照具體揚(yáng)聲器單元
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一種制作分頻器的方法
在制作音箱時(shí)，分頻器大多選用市售成品，但市場(chǎng)上出售的分頻器良莠不齊，質(zhì)量上乘者多在百元以上，非初級(jí)燒友所能接受。價(jià)格在幾十元以下的分頻器質(zhì)量難以保證，實(shí)際使用表現(xiàn)平庸。自制分頻器可以較少的投入換取較大
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分頻器的"階"與"路"
在音箱評(píng)測(cè)尤其是2.0中高端音箱評(píng)測(cè)中，大家一定會(huì)談到分頻器。對(duì)于音箱來(lái)說(shuō)，分頻器是非常重要的。但往往大家容易在對(duì)分頻器的描述上出現(xiàn)錯(cuò)誤，什么是分頻器的“階”，什么是分頻器的“路”，下
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基于VHDL和FPGA的多種分頻的實(shí)現(xiàn)方法
基于VHDL和FPGA的多種分頻的實(shí)現(xiàn)方法
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教你制作Esquire紳士音箱
Esquire是小型兩路揚(yáng)聲器，采用單元為Vifa的 P13WH-00-08中低音單元和Vifa的 D27TG-45-06軟球頂高音單元。外型見(jiàn)圖1。 制作這揚(yáng)聲器的是想通過(guò)有限的投資獲得高質(zhì)量的回報(bào)，而且作者也不需要低于80HZ的低頻，
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一種高碼速率的微波鎖相調(diào)頻源
摘 要：介紹了準(zhǔn)兩點(diǎn)注入式調(diào)頻技術(shù)，以及相關(guān)電路設(shè)計(jì)和實(shí)驗(yàn)結(jié)果。理論分析和實(shí)踐表明，準(zhǔn)兩點(diǎn)注入式鎖相調(diào)頻源具有平坦的寬帶調(diào)制特性，能滿足高碼速率測(cè)控通信發(fā)射設(shè)備的實(shí)際要求。關(guān)鍵詞： 測(cè)控通信 鎖相 調(diào)頻源
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TTL集成晶體振蕩器與分頻器
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1488kHz晶體發(fā)生器與分頻器
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高保真揚(yáng)聲器3路和4路分頻器
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射頻預(yù)分頻器ADF500x（ADI）
ADI最近推出新款 射頻預(yù)分頻電路，可用于各種應(yīng)用，包括點(diǎn)到點(diǎn)無(wú)線電、VSAT（甚小口徑終端）和微波通信系統(tǒng)。預(yù)分頻器電路的作用是產(chǎn)生一個(gè)頻率為輸入信號(hào)頻率小數(shù)分頻的輸出信號(hào)。ADF500x 射頻預(yù)分頻器采用業(yè)界領(lǐng)先
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高性能、四路輸出時(shí)鐘發(fā)生器MAX3679A（Maxim）
Maxim推出用于以太網(wǎng)設(shè)備的高性能、四路輸出時(shí)鐘發(fā)生器MAX3679A。器件采用低噪聲VCO和PLL架構(gòu)，能夠從低頻晶體或參考時(shí)鐘輸入產(chǎn)生高頻、超低抖動(dòng)(0.36psRMS，典型值)時(shí)鐘信號(hào)。傳統(tǒng)的解決方案需要一個(gè)昂貴的晶體振蕩
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一種超低功耗5.8GHz雙模前置分頻器設(shè)計(jì)
摘要：基于目前流行的TSPC高速電路，利用TSMC90nm 1．P9M 1．2V CMOS工藝設(shè)計(jì)了高速、低壓、低功耗32／33雙模前置分頻器，其適用于WLAN IEEE802．1la通信標(biāo)準(zhǔn)。運(yùn)用Mentor Graphics Eldo對(duì)該電路進(jìn)行仿真，仿真結(jié)果顯
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一種超低功耗5.8GHz雙模前置分頻器設(shè)計(jì)
摘要：基于目前流行的TSPC高速電路，利用TSMC90nm 1．P9M 1．2V CMOS工藝設(shè)計(jì)了高速、低壓、低功耗32／33雙模前置分頻器，其適用于WLAN IEEE802．1la通信標(biāo)準(zhǔn)。運(yùn)用Mentor Graphics Eldo對(duì)該電路進(jìn)行仿真，仿真結(jié)果顯
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基于FPGA的多種分頻設(shè)計(jì)與實(shí)現(xiàn)
0 引言分頻器是FPGA設(shè)計(jì)中使用頻率非常高的基本單元之一。盡管目前在大部分設(shè)計(jì)中還廣泛使用集成鎖相環(huán)(如altera的PLL，Xilinx的DLL)來(lái)進(jìn)行時(shí)鐘的分頻、倍頻以及相移設(shè)計(jì)，但是，對(duì)于時(shí)鐘要求不太嚴(yán)格的設(shè)計(jì)，通過(guò)自
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基于ADF4360-1的本振源設(shè)計(jì)
0 引 言 在無(wú)線通信領(lǐng)域，本振信號(hào)性能的優(yōu)劣是影響混頻器輸出頻譜純度的主要因素。頻率合成技術(shù)是指由一個(gè)穩(wěn)定、準(zhǔn)確的標(biāo)準(zhǔn)參考頻率，經(jīng)過(guò)一系列的處理過(guò)程，產(chǎn)生大量離散的具有同一穩(wěn)定度和準(zhǔn)確度的信號(hào)頻率
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高性能、三路輸出時(shí)鐘發(fā)生器MAX3625B（Maxim）
Maxim近日推出高性能、三路輸出時(shí)鐘發(fā)生器MAX3625B，適用于以太網(wǎng)和光纖通道網(wǎng)絡(luò)設(shè)備。器件采用低噪聲VCO和PLL架構(gòu)，能夠從低頻晶體或參考時(shí)鐘輸入產(chǎn)生高頻、超低抖動(dòng)(0.36psRMS)時(shí)鐘信號(hào)。器件具有-57dBc的PSNR，大
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10~37 GHz CMOS四分頻器的設(shè)計(jì)
1 引言 隨著通信技術(shù)的迅猛發(fā)展，人們對(duì)通信系統(tǒng)中單元電路的研究也越來(lái)越多。而分頻器廣泛應(yīng)用于光纖通信和射頻通信系統(tǒng)中，因此，高速分頻器的研究也日益受到關(guān)注。分頻器按實(shí)現(xiàn)方式可分為模擬和數(shù)字兩種。模
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基于CPLD/FPGA的多功能分頻器的設(shè)計(jì)與實(shí)現(xiàn)
引言 分頻器在CPLD/FPGA設(shè)計(jì)中使用頻率比較高,盡管目前大部分設(shè)計(jì)中采用芯片廠家集成的鎖相環(huán)資源 ,但是對(duì)于要求奇數(shù)倍分頻（如3、5等）、小數(shù)倍（如2.5、3.5等）分頻、占空比50%的應(yīng)用場(chǎng)合卻往往不能滿足要求。
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