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FPGA

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

  • Microchip借助NVIDIA Holoscan平臺加速實時邊緣AI部署

    PolarFire? FPGA 以太網(wǎng)傳感器橋接器為NVIDIA邊緣 AI 平臺提供低功耗多傳感器橋接功能

  • 短波接收機模數(shù)混合AGC設(shè)計

    為解決短波通信中衰落帶來的輸入信號起伏不定的問題 ,設(shè)計了一種用于短波接收機的模數(shù)混合AGC(Automatic Gain Control , 自動增益控制),介紹了AGC的組成和FPGA設(shè)計方案。該方法采用自然對數(shù)算法 ,通過檢測輸入信號的幅度與門限電平比較 ,輸出控制信號分別控制模擬增益調(diào)節(jié)電路和數(shù)字增益調(diào)節(jié)電路。實際測試表明 ,該AGC電路可以控制較大范圍的射頻輸入信號 ,正確解調(diào)并輸出穩(wěn)定的音頻信號 , 同時具有快充慢放功能。

  • AMD 宣布推出第二代 Versal Premium 系列，實現(xiàn)全新系統(tǒng)加速水平，滿足數(shù)據(jù)密集型工作負載需求

    — 以業(yè)界首款采用 CXL 3.1 及 PCIe Gen6 并支持 LPDDR5 的 FPGA 器件擴展第二代 Versal 產(chǎn)品組合，助力快速連接、更高效數(shù)據(jù)遷移并釋放更多內(nèi)存—

  • 一種集成FPGA和DSP芯粒的異構(gòu)系統(tǒng)級封裝

    一種集成FPGA（現(xiàn)場可編程門陣列）和DSP（數(shù)字信號處理器）芯粒的異構(gòu)系統(tǒng)級封裝（SiP）是一種具有創(chuàng)新性和實用性的技術(shù)解決方案。以下是對這種異構(gòu)系統(tǒng)級封裝的詳細解析：

  • 基于FPGA的“俄羅斯方塊”設(shè)計

    在當今的數(shù)字時代，現(xiàn)場可編程門陣列（FPGA）因其靈活性和高性能，被廣泛應(yīng)用于各種嵌入式系統(tǒng)和游戲開發(fā)中。本文將介紹一個基于FPGA的“俄羅斯方塊”游戲設(shè)計，詳細闡述系統(tǒng)架構(gòu)、模塊劃分及實現(xiàn)原理，并附上部分代碼示例。

  • 長生命周期保障創(chuàng)新，米爾 FPGA SoM產(chǎn)品的優(yōu)勢

    米爾電子作為行業(yè)領(lǐng)先的解決方案供應(yīng)商，致力于打造高可靠性、長生命周期的FPGA SoM（System on Module）產(chǎn)品，滿足工業(yè)、汽車、醫(yī)療，電力等嚴苛應(yīng)用領(lǐng)域的需求。

    米爾電子
    2024-10-31
    SoC FPGA

  • 重新定義未來的可信根架構(gòu)

    企業(yè)環(huán)境的快速數(shù)字化、復(fù)雜網(wǎng)絡(luò)威脅的激增、安全法規(guī)的不斷演變以及量子計算技術(shù)的崛起，在網(wǎng)絡(luò)安全領(lǐng)域掀起了層層巨浪，行業(yè)對敏捷性和彈性也提出了更高的要求。為了應(yīng)對這種情況，企業(yè)必須在網(wǎng)絡(luò)防御和合規(guī)方面保持積極主動的態(tài)度。在最新的萊迪思安全研討會上，萊迪思安全專家與來自AMI和Rambus的合作伙伴共同探討了企業(yè)如何利用先進的安全技術(shù)駕馭新的監(jiān)管環(huán)境。討論內(nèi)容包括可信平臺模塊（TPM）技術(shù)的最新進展、使用Caliptra創(chuàng)新推出的測量信任根（RoTM），以及將這些解決方案無縫集成到現(xiàn)場可編程門陣列（FPGA）技術(shù)實施中。

  • 實際案例說明用基于FPGA的原型來測試、驗證和確認IP——如何做到魚與熊掌兼得?

    本系列文章從數(shù)字芯片設(shè)計項目技術(shù)總監(jiān)的角度出發(fā)，介紹了如何將芯片的產(chǎn)品定義與設(shè)計和驗證規(guī)劃進行結(jié)合，詳細講述了在FPGA上使用硅知識產(chǎn)權(quán)(IP)內(nèi)核來開發(fā)ASIC原型項目時，必須認真考慮的一些問題。

  • 萊迪思宣布開發(fā)者大會演講嘉賓陣容

    中國上海——2024年10月24日——萊迪思半導(dǎo)體公司(NASDAQ：LSCC)低功耗可編程器件的領(lǐng)先供應(yīng)商，今日宣布了將于2024年12月10日至11日舉行的萊迪思開發(fā)者大會的完整議程和演講者陣容。此次線上線下雙渠道盛會將邀請戴爾、微軟、SICK和Teledyne FLIR等公司的嘉賓做主題演講，萊迪思和其他行業(yè)專家將進行小組討論，并展示基于FPGA的強大技術(shù)演示。生態(tài)系統(tǒng)合作伙伴和行業(yè)領(lǐng)導(dǎo)者將共同探討低功耗FPGA解決方案在網(wǎng)絡(luò)邊緣人工智能、安全和先進互連方面的尖端技術(shù)和優(yōu)勢。

  • FPGA實現(xiàn)串口升級及MultiBoot：BPI FLASH相關(guān)實例演示

    在現(xiàn)代嵌入式系統(tǒng)設(shè)計中，F(xiàn)PGA（現(xiàn)場可編程門陣列）的靈活性和可重構(gòu)性使其成為許多應(yīng)用的理想選擇。而在FPGA的開發(fā)和部署過程中，如何實現(xiàn)遠程升級和故障恢復(fù)成為了一個重要議題。本文將詳細探討如何通過BPI FLASH實現(xiàn)FPGA的串口升級及MultiBoot功能，并提供一個實例演示。

  • 使用FPGA制作便攜式ADAS系統(tǒng)：技術(shù)探索與實現(xiàn)

    隨著自動駕駛技術(shù)的飛速發(fā)展，高級駕駛輔助系統(tǒng)（ADAS）已成為現(xiàn)代汽車的重要組成部分。ADAS利用先進的傳感器、攝像頭和算法，為駕駛員提供重要的道路信息，協(xié)助其避免潛在危險，提升駕駛安全性。本文將探討如何使用FPGA（現(xiàn)場可編程門陣列）制作一個便攜式ADAS系統(tǒng)，并附上相關(guān)代碼示例。

  • RTL與HLS強強聯(lián)合：開辟FPGA新開發(fā)之路

    在當今快速發(fā)展的硬件設(shè)計領(lǐng)域，現(xiàn)場可編程門陣列（FPGA）以其高度的靈活性和可定制性，成為了眾多應(yīng)用領(lǐng)域的首選。然而，隨著設(shè)計復(fù)雜性的不斷增加，傳統(tǒng)的寄存器傳輸級（RTL）設(shè)計方法逐漸暴露出設(shè)計周期長、資源消耗大等問題。為了應(yīng)對這些挑戰(zhàn)，高層次綜合（HLS）技術(shù)應(yīng)運而生，它與RTL的結(jié)合為FPGA的開發(fā)開辟了一條全新的道路。

  • FPGA在汽車電子中的應(yīng)用：ADAS系統(tǒng)的革新力量

    隨著汽車電子技術(shù)的飛速發(fā)展，高級駕駛輔助系統(tǒng)（ADAS）已成為現(xiàn)代汽車不可或缺的一部分。ADAS通過集成多種傳感器、控制器和執(zhí)行器，為駕駛員提供駕駛輔助，提高行車安全性，降低駕駛疲勞，并逐步向自動駕駛邁進。在這一進程中，現(xiàn)場可編程門陣列（FPGA）以其獨特的優(yōu)勢，在ADAS系統(tǒng)中發(fā)揮著越來越重要的作用。

    汽車電子
    2024-10-24
    ADAS FPGA

  • 適用FPGA的小型神經(jīng)網(wǎng)絡(luò)：加速邊緣智能的新篇章

    在人工智能（AI）技術(shù)日新月異的今天，神經(jīng)網(wǎng)絡(luò)作為其核心驅(qū)動力，正逐步滲透到各個行業(yè)與領(lǐng)域。然而，傳統(tǒng)的神經(jīng)網(wǎng)絡(luò)模型往往受限于計算資源和功耗，難以在邊緣設(shè)備上實現(xiàn)高效運行?，F(xiàn)場可編程門陣列（FPGA）作為一種高性能、低功耗的硬件加速器，為小型神經(jīng)網(wǎng)絡(luò)的部署提供了理想的平臺。本文將深入探討適用于FPGA的小型神經(jīng)網(wǎng)絡(luò)，以及它們在邊緣智能應(yīng)用中的獨特優(yōu)勢。

  • FPGA與ASIC：效率差異的深度剖析

    在半導(dǎo)體技術(shù)的快速發(fā)展中，現(xiàn)場可編程門陣列（FPGA）和專用集成電路（ASIC）作為兩種重要的硬件平臺，各自在不同的應(yīng)用領(lǐng)域中發(fā)揮著關(guān)鍵作用。盡管FPGA以其靈活性和可編程性著稱，但在效率方面，它通常低于ASIC。本文將從多個維度深入探討FPGA與ASIC之間的效率差異，以及這些差異背后的原因。

  • “軟核”硬做：ODrive的FPGA版本探索

    在硬件設(shè)計的廣闊領(lǐng)域中，F(xiàn)PGA（現(xiàn)場可編程門陣列）以其高度的靈活性和可編程性，成為了眾多創(chuàng)新項目的核心。其中，ODrive作為一個開源的、高精度的無刷電機驅(qū)動器項目，也迎來了其FPGA版本的誕生。這一版本不僅繼承了ODrive的高性能特性，還通過FPGA的硬件加速能力，進一步提升了系統(tǒng)的實時性和可靠性。本文將深入探討ODrive FPGA版本的設(shè)計思路、實現(xiàn)過程以及關(guān)鍵技術(shù)，并附上部分代碼示例。

    智能硬件
    2024-10-24
    ODrive FPGA

  • FPGA的綜合和約束的關(guān)系：優(yōu)化設(shè)計與性能的關(guān)鍵

    在FPGA（現(xiàn)場可編程門陣列）設(shè)計中，綜合（Synthesis）和約束（Constraints）是兩個至關(guān)重要的環(huán)節(jié)，它們共同決定了設(shè)計的最終性能和資源利用率。本文將深入探討FPGA綜合和約束之間的關(guān)系，以及它們?nèi)绾斡绊懺O(shè)計流程、資源分配、時序性能和調(diào)試維護等方面。

  • 使用機器學(xué)習(xí)預(yù)測FPGA的執(zhí)行時間與功耗：一種創(chuàng)新的方法

    隨著科技的飛速發(fā)展，現(xiàn)場可編程門陣列（FPGA）在高性能計算、數(shù)據(jù)中心、人工智能等領(lǐng)域的應(yīng)用日益廣泛。然而，F(xiàn)PGA設(shè)計的復(fù)雜性和功耗問題一直是制約其性能提升的關(guān)鍵因素。近年來，機器學(xué)習(xí)（ML）技術(shù)的興起為FPGA的執(zhí)行時間與功耗預(yù)測提供了新的解決方案。本文將探討如何使用機器學(xué)習(xí)進行FPGA的執(zhí)行時間與功耗預(yù)測，并分析其優(yōu)勢與挑戰(zhàn)。

  • 簡談FPGA比特流結(jié)構(gòu)

    在現(xiàn)代電子設(shè)計中，F(xiàn)PGA（現(xiàn)場可編程門陣列）因其高度的靈活性和可配置性而得到廣泛應(yīng)用。FPGA的靈活性主要來源于其內(nèi)部配置存儲器，這些配置信息通常以比特流的形式存儲和加載。本文將深入探討FPGA比特流的結(jié)構(gòu)及其在Vivado開發(fā)環(huán)境中的重要性。

  • YoloV3在FPGA上的量化、編譯與推理

    隨著人工智能技術(shù)的快速發(fā)展，目標檢測作為計算機視覺領(lǐng)域的重要應(yīng)用，其準確性和實時性要求日益提高。YoloV3（You Only Look Once Version 3）作為一種先進的實時物體檢測算法，憑借其高精度和實時性能，在眾多應(yīng)用場景中展現(xiàn)出巨大潛力。然而，為了將YoloV3算法部署到資源受限的硬件平臺上，如FPGA（現(xiàn)場可編程門陣列），需要進行一系列的優(yōu)化工作，包括量化、編譯和推理。本文將詳細介紹YoloV3在FPGA上的量化、編譯與推理過程。