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[導(dǎo)讀]信道編碼專(zhuān)家AccelerComm正在使用尖端物理層IP為5G NR加速,從而提高頻譜效率并減少延遲。

Southampton, UK – 2021年3月1日: 信道編碼專(zhuān)家AccelerComm正在使用尖端物理層IP為5G NR加速,從而提高頻譜效率并減少延遲。公司今天宣布完整的高性能5G NR PUSCH(物理上行鏈路共享信道)解碼器和PDSCH(物理下行鏈路共享信道)編碼器,服務(wù)于希望最大限度發(fā)揮其5G無(wú)線網(wǎng)絡(luò)的客戶(hù)。AccelerComm將向MWC 上海與會(huì)者展示PUSCH解碼器和其他頻道代碼解決方案。

AccelerComm推出完全集成的PUSCH解碼器 為性能關(guān)鍵的信道加快5G NR

這一高度集成的解決方案基于公司的信道編碼和調(diào)制/解調(diào)IP產(chǎn)品組合,使5G基站能夠受益于AccelerComm一流的LDPC解碼器性能,同時(shí)最大限度地縮短上市時(shí)間。

AccelerComm銷(xiāo)售和營(yíng)銷(xiāo)副總裁Robert Barnes表示:”頻譜是一種稀缺資源,是移動(dòng)運(yùn)營(yíng)商擁有的關(guān)鍵資產(chǎn),因此最大限度地利用頻譜至關(guān)重要 — 每個(gè)dB都很重要。該產(chǎn)品基于現(xiàn)有的AccelerComm IP產(chǎn)品組合,使運(yùn)營(yíng)商能夠利用其已有的頻譜和云端無(wú)線接入網(wǎng)(Cloud RAN)基礎(chǔ)設(shè)施實(shí)現(xiàn)5G高性能和低延遲的承諾。”

AccelerComm的PUSCH解碼器將其他3GPP物理層功能與其高性能LDPC解碼器集成在一起,以創(chuàng)建符合3GPP標(biāo)準(zhǔn)的IP封裝,可快速集成和優(yōu)化用于可定制硅芯片(ASIC)和可編程硬件(FPGA)。靈活的架構(gòu)意味著它可以根據(jù)運(yùn)營(yíng)商的服務(wù)需求進(jìn)行定制,從而實(shí)現(xiàn)最佳性能、功耗和硅面積,并根據(jù)其特定需求進(jìn)行定制。

來(lái)自AccelerComm的這款最新產(chǎn)品增加了新的IP塊,以完成LDPC解碼器和MIMO檢測(cè)器之間的連接:

*gNodeB上行鏈路棧(PUSCH解碼器)

o具有傳輸塊封裝器、Polar解碼器、多路輸出選擇器、反擾碼器和QAM解調(diào)器的LDPC解碼器

*gNodeB下行鏈路棧(PDSCH編碼器)

o具有傳輸塊封裝器、擾碼器和QAM調(diào)制器的LDPC編碼器

該規(guī)范如3GPP文件TS38.212的第6.2和7.2節(jié)以及TS38.211的第6.3.1.1、6.3.1.2、7.3.1.1和7.3.1.2節(jié)所定義。

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