幾乎所有的電子設計師和嵌入式系統(tǒng)開發(fā)人員都聽過現(xiàn)場可編程門陣列(FPGA)。對于實際的FPGA器件，設計人員和開發(fā)人員都知道它擁有可編程架構(gòu)，能夠?qū)ζ溥M行配置來而執(zhí)行想要的功能，但他們的了解可能僅限于此。同樣，當涉及創(chuàng)建一個可以在FPGA上實現(xiàn)的設計時，他們可能聽過硬件描述語言(HDL)和寄存器轉(zhuǎn)換級電路(RTL)之類的術(shù)語，但可能并未充分理解它們的含義。

與Verilog或VHDL相似，HDL能讓FPGA設計人員描述設計意圖，正如軟件開發(fā)人員使用C++或者C++等編程語言一樣。理解HDL的方式之一就是它可以用來描述同時發(fā)生的事物，這也是現(xiàn)實世界中硬件工作的方式。相比之下，軟件編程語言通常用于描述順序發(fā)生的事。

同時，RTL是常用于邏輯綜合引擎輸入的抽象級電路。該工具將RTL轉(zhuǎn)換到邏輯元件和互連網(wǎng)絡，然后在FPGA的可編程邏輯內(nèi)實現(xiàn)。邏輯綜合引擎可以比作軟件開發(fā)者的編譯器，后者采用高級程序作為輸入，并將其轉(zhuǎn)換為由處理器執(zhí)行的機器代碼。

FPGA的可編程結(jié)構(gòu)可用于構(gòu)建硬件加速器，以低功耗執(zhí)行數(shù)據(jù)處理任務。可編程結(jié)構(gòu)經(jīng)過配置后可創(chuàng)建一個或多個更適合處理決策任務的軟核處理器，這些處理器還可以控制硬件加速器，包括向其提供數(shù)據(jù)并根據(jù)結(jié)果采取相應措施。

RISC-V就是這樣一種處理器，它是一種開源指令集架構(gòu)(ISA)，可以通過開源許可免費獲得。RISC-V開源硬件概念的創(chuàng)造者受到Linux開源軟件成功的啟發(fā)。RISC-V的一大優(yōu)勢是在各類設計實現(xiàn)中都有出色的軟件兼容性，并且目前這些處理器的使用急劇增長。

然而，對于想要使用這種處理器的非FPGA設計人員而言，問題在于他們?nèi)狈τ嘘P(guān)FPGA設計語言、工具和流程的專業(yè)知識。為了解決這個問題，低功耗可編程FPGA的領(lǐng)先供應商萊迪思半導體開發(fā)了名為LatTIcePropel?的工具，這是一款基于圖形用戶界面(GUI)的設計環(huán)境，任何用戶(無論是否具有FPGA專業(yè)知識)都能使用它以拖放的方式快速設計基于RISC-V處理器的系統(tǒng)。

Propel輸出的是RTL文件，可以發(fā)送到綜合引擎，生成可載入FPGA的配置文件。之后軟件開發(fā)人員可以在基于FPGA的RISC-V設計實現(xiàn)上運行他們的RISC-V可執(zhí)行文件，正如在其他任何RISC-V處理器上運行一樣。萊迪思為其FPGA客戶免費提供RISC-VIP核。

基于FPGA的解決方案

數(shù)據(jù)處理要求有合適的計算引擎。開發(fā)者擁有諸多不同選擇，包括微處理器(MPU)、微控制器(MCU)、圖形處理器(GPU)、FPGA和SoC等器件。

MPU和MCU在執(zhí)行決策任務時效率很高，但是在實現(xiàn)原始數(shù)據(jù)處理算法時，無論是處理時間還是功耗都不太理想。SoC能以最低的功耗實現(xiàn)最高性能，但缺點是開發(fā)起來價格昂貴、耗費資源且十分耗時，并且在此類芯片架構(gòu)中實現(xiàn)的算法基本上都是固定無法更改的，而系統(tǒng)采用的協(xié)議和標準會不斷變化，因此會帶來很多問題。

某些數(shù)據(jù)處理任務(包括許多AI/ML算法)非常適合并行處理。FPGA的可編程架構(gòu)(圖1a)經(jīng)配置可實現(xiàn)硬件加速器(HA)功能，以大規(guī)模并行方式執(zhí)行任務(圖1b)，從而顯著提高性能，同時降低功耗。

許多情況下還需要數(shù)據(jù)協(xié)處理功能，使用中央處理器(CPU)來強化硬件加速器，處理器可以執(zhí)行高級決策和控制功能。不同于直接在芯片中實現(xiàn)的硬核CPU，F(xiàn)PGA的可編程架構(gòu)能夠?qū)崿F(xiàn)軟核CPU以及相關(guān)的總線結(jié)構(gòu)(地址、數(shù)據(jù)、控制)和任何所需的外設IP功能(圖1c)。

圖1.結(jié)構(gòu)化總線的方法廣泛適用于各類應用，包括嵌入式視覺、安防和人工智能。

需要注意的是，根據(jù)FPGA器件和用戶的要求，額外的可編程邏輯功能和外圍通信功能(例如USB、MIPI、I2C、SPI、CAN和UART)可以通過硬核和/或軟核實現(xiàn)。文章篇幅有限此處不作贅述。

使用軟核CPU有諸多優(yōu)點，包括能夠配置處理器的操作及許多可選功能，如動態(tài)內(nèi)存訪問(DMA)控制器，從而對其精確調(diào)整，高效地滿足目標應用的要求。此外，如有需要，可以配置可編程結(jié)構(gòu)實現(xiàn)其他外設IP功能。如在人工智能應用中，可以使用可編程邏輯資源來創(chuàng)建簡單的人工神經(jīng)網(wǎng)絡，用于推理之類的任務。

RISC-V

如前所述，RISC-V是基于已有的精簡指令集計算機(RISC)原則的開源指令集架構(gòu)，可通過開源許可獲得。此外，許多公司目前提供支持RISC-V的RISC-V硬核或開源操作系統(tǒng)，并且?guī)追N主流的軟件工具鏈均支持該指令集。

RISC-V的模塊化設計包括基礎(chǔ)指令集和其他的擴展指令集。在行業(yè)、技術(shù)界和教育機構(gòu)的共同努力下，兩者已得到長足的發(fā)展?；A(chǔ)指令集規(guī)定了指令(及其編碼)、控制流、寄存器(及其大小)、存儲器和尋址、邏輯(即整數(shù))操作以及輔助功能。僅基礎(chǔ)指令集就能實現(xiàn)具有全面軟件支持(包括通用編譯器)的通用計算機。

還可以通過可選拓展指令集實現(xiàn)額外功能，從而讓設計人員靈活選擇其應用所需的功能。RISC-V定義了許多擴展指令集，包括A(原子)、F(單精度浮點)、D(雙精度浮點)、Q(四精度浮點)和C(壓縮的16位指令以減少代碼尺寸，用于存儲空間有限的系統(tǒng))。上述指令集均可靈活選擇。

圖2.萊迪思是首個支持RISC-V的基于閃存和SRAM的FPGA供應商。

與作為專用處理器的硬核實現(xiàn)相比，基于FPGA的軟核RISC-V擁有的巨大優(yōu)勢在于FPGA可重新配置的巨大潛力能夠滿足各種擴展需求。

萊迪思RISC-V軟核IP套件擁有32位RISC-V處理器核以及可選的定時器和可編程中斷控制器(PIC)子模塊。該CPU核支持RV32I指令集、外部中斷和符合JTAGIEEE1149.1規(guī)范的調(diào)試。

定時器子模塊是一個64位實時計數(shù)器，它將實時寄存器與另一個寄存器進行比較以觸發(fā)定時器中斷。PIC子模塊最多將八個外部中斷輸入聚合為一個外部中斷。處理器核通過使用行業(yè)標準的32位AHB-L總線接口訪問子模塊寄存器。

萊迪思Propel

許多嵌入式系統(tǒng)的設計人員都對使用FPGA很感興趣，但是一想到要使用傳統(tǒng)的FPGA設計工具和HDL就望而卻步。為了解決這一問題，萊迪思Propel采用了基于圖形用戶界面(GUI)的設計環(huán)境，任何用戶(無論是否具有FPGA專業(yè)知識)都能使用其拖放的設計方式快速構(gòu)建和配置基于RISC-V處理器的設計。

Propel輸出的是使用VerilogHDL語言的RTL文件，可以將其發(fā)送到綜合引擎，生成可載入FPGA的配置文件。該配置文件可用于萊迪思CrossLink?-NX(面向嵌入式視覺應用)、Certus?-NX(通用FPGA)以及MachXO3D?和Mach?-NXFPGA(安全系統(tǒng)控制)系列產(chǎn)品。FPGA配置完成后，軟件開發(fā)人員可以在基于FPGA的RISC-V設計實現(xiàn)上運行他們的RISC-V可執(zhí)行文件，正如在其他任何RISC-V處理器上運行一樣。

圖3.Propel界面直觀、易于使用、功能強大。

除了拖放IP實例化，PropelBuilder還能自動進行引腳連接，通過向?qū)渲煤驮O置參數(shù)以及采用按構(gòu)造逐步校正進行IP集成。

其次是萊迪思PropelSDK(軟件開發(fā)套件)，可提供無縫的軟件開發(fā)環(huán)境。它擁有行業(yè)標準的集成開發(fā)環(huán)境(IDE)和工具鏈。SDK還為PropelBuilder定義的系統(tǒng)提供軟件/硬件調(diào)試功能以及軟件庫和板級支持包(BSP)。

需要注意的重要一點是，Propel可以很好地對接下游工具，并且它也是一個獨立的程序，且其大小僅為0.5GB，可以快速輕松地下載和安裝。同樣令人感興趣的是，Propel的所有命令都可以用Tcl編寫，從而提高了設計效率并將其快速集成到用戶自己的設計環(huán)境中。

圖4.無論是簡單的“HelloWorld”應用還是復雜的嵌入式控制和數(shù)據(jù)處理系統(tǒng)，Propel都能讓用戶快速完成設計

對于硬件設計，Propel是那些需要FPGA優(yōu)勢但缺乏FPGA硬件設計經(jīng)驗的團隊的理想選擇。此外，如果團隊成員確實具有FPGA設計經(jīng)驗，那么他們還可以根據(jù)需要對設計做更為精確的控制。對于軟件設計，Propel提供行業(yè)標準的C/C++開發(fā)環(huán)境。軟件開發(fā)人員似乎更多地使用現(xiàn)成的微控制器。

設計人員可以使用Propel在CrossLink-NX、Certus-NX和Mach-NXFPGA中快速輕松地生成基于RISC-V軟軟核的處理器系統(tǒng)，從而提供復雜的視頻處理、系統(tǒng)控制和系統(tǒng)安全功能，其延遲遠遠低于通過外部獨立處理器實現(xiàn)的設計。

總結(jié)

除了擁有以低功耗執(zhí)行高性能數(shù)據(jù)處理任務的邏輯功能和硬件加速器外，F(xiàn)PGA內(nèi)部的可編程架構(gòu)還可用于實現(xiàn)一個或多個更適合決策任務的軟核處理器，以及用于諸如硬件加速器之類的控制功能，包括向它們提供數(shù)據(jù)并根據(jù)結(jié)果采取措施。

RISC-V就是這樣一種處理器，它是一種開源指令集架構(gòu)(ISA)，可以通過開源許可免費獲得。萊迪思是首個支持RISC-V以及為其FPGA客戶免費提供RISC-VIP核的基于閃存和SRAM的FPGA供應商。

對于想要使用這種處理器的非FPGA設計人員而言，問題在于他們?nèi)狈τ嘘P(guān)FPGA設計語言、工具和流程的專業(yè)知識。為了解決這個問題，萊迪思提供了Propel來簡化設計流程，讓開發(fā)人員能夠快速設計基于RISC-V處理器的系統(tǒng)。