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[導(dǎo)讀]大家好,我是記得誠。在電路設(shè)計(jì)中,“信號”始終是工程師無法繞開的一個知識點(diǎn)。不管是在設(shè)計(jì)之初,還是在測試環(huán)節(jié)中,信號質(zhì)量問題都值得關(guān)注。在本文中,主要介紹信號相關(guān)的四類問題:信號過沖、毛刺(噪聲)、回溝(臺階)、信號邊沿緩慢。一、信號過沖如下圖是信號過沖的常見波形圖:危害1、超過...

大家好,我是記得誠。

在電路設(shè)計(jì)中,“信號”始終是工程師無法繞開的一個知識點(diǎn)。不管是在設(shè)計(jì)之初,還是在測試環(huán)節(jié)中,信號質(zhì)量問題都值得關(guān)注。在本文中,主要介紹信號相關(guān)的四類問題:信號過沖、毛刺(噪聲)、回溝(臺階)、信號邊沿緩慢。

一、信號過沖

如下圖是信號過沖的常見波形圖:

危害

1、超過正常供電范圍,會產(chǎn)生閂鎖效應(yīng)(現(xiàn)在由于廠家工藝改進(jìn), 閂鎖問題基本上可以得到規(guī)避。但是長時(shí)間的信號過沖會使得器件失效率增加);?

2、形成干擾源, 對其它器件造成串?dāng)_;

3、管腳上的負(fù)電壓可能使器件PN襯底( 寄生二極管) 前向偏置,流過的大電流過大時(shí),熔斷鍵絲產(chǎn)生開路;

產(chǎn)生原因

1、 其它相鄰信號串?dāng)_;

2、 器件驅(qū)動能力太強(qiáng);

3、 沒有匹配或者匹配不當(dāng);

解決方法

1、 PCB布線避開干擾源和耦合路徑;

2、 增加電阻匹配,參考做法是源端串電阻或者末端并電阻,減 少過沖;

如下圖是不同匹配電阻下同一信號的上升沿波形,可以看出,通過調(diào)節(jié)源端匹配電阻,可以減緩信號上升沿。

二、毛刺(噪聲)

如下圖是毛刺的常見波形圖:

危害

容易造成控制信號控制錯誤或時(shí)鐘信號相位發(fā)生錯誤:

1、數(shù)據(jù)線上的毛刺如果被采樣到,可能造成判斷結(jié)果錯誤;

2、邊沿觸發(fā)的器件中,時(shí)鐘線上的毛刺可能會使得采樣到多余的數(shù)據(jù) (相當(dāng)于多了一拍時(shí)鐘);

產(chǎn)生原因

1、PCB走線串?dāng)_(例如數(shù)據(jù)線和時(shí)鐘線并行走線較長,信號線放置在晶振等干擾源附近);

2、外界干擾,如地線噪聲等;

3、邏輯出現(xiàn)競爭、冒險(xiǎn);

注:兩個輸入信號同時(shí)向相反方向的邏輯電平跳變的現(xiàn)象(即一個由1---> 0, 另一個從0 ---> 1),稱為競爭。因競爭導(dǎo)致在輸出端可能產(chǎn)生尖峰脈沖的現(xiàn)象,稱為冒險(xiǎn)。

解決方法

1、控制器件布局和PCB走線,信號遠(yuǎn)離干擾源;

2、添加去耦電容或輸出濾波等,濾波器件盡量靠近信號管腳;

3、邏輯設(shè)計(jì)中添加冗余項(xiàng),或者采用同步邏輯設(shè)計(jì),避免競爭冒險(xiǎn);

三、回勾(臺階)

如下圖是回溝、臺階的常見波形圖:

危害

1、主要是時(shí)鐘類信號上的回勾有危害, 可能會使得采樣到多余的數(shù)據(jù)(相當(dāng)于多了一拍時(shí)鐘),影響了時(shí)鐘信號上升沿和下降沿的單調(diào)性;

2、對于電源信號,上電邊沿的回勾可能導(dǎo)致系統(tǒng)死機(jī),需要結(jié)合復(fù)位信號判斷是否可以接受;

3、數(shù)據(jù)信號由于一般是在數(shù)據(jù)的中間采樣,回勾的影響不是很大(除非速率很高,建立保持時(shí)間1~2ns,這時(shí)需要考慮回勾對數(shù)據(jù)的影響);

產(chǎn)生原因

匹配不當(dāng), 信號放射回來形成回勾。

解決方法

增加合適的匹配電阻。

四、信號邊沿緩慢

由于驅(qū)動不足或者負(fù)載過大,信號邊沿緩慢常常伴隨著信號幅度較低現(xiàn)象。

如下圖是振蕩的常見波形圖:

危害

上升、下降沿緩慢發(fā)生在數(shù)據(jù)信號線上(串口信號線,HW信號線等)時(shí),會造成數(shù)據(jù)采樣錯誤。

產(chǎn)生原因

驅(qū)動能力不夠,或者負(fù)載過大(例如鏈路阻抗太大)。

解決方法

1、提高驅(qū)動能力;

2、減小負(fù)載;


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