FPGA

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

基于FPGA的溫度自動控制系統(tǒng)

溫度控制系統(tǒng)在工農(nóng)業(yè)中應(yīng)用廣泛，但大多數(shù)的溫度控制系統(tǒng)存在一定的問題，為了提高溫度控制系統(tǒng)的穩(wěn)定性和精確性，提出一種基于FPGA的溫度自動控制系統(tǒng)。該系統(tǒng)設(shè)計是以MCS-5l單片機(jī)為核心，結(jié)合由精密熱電偶攝氏溫度傳感器和精密A／D轉(zhuǎn)換器構(gòu)成的前級信號采集電路和由FPGA、雙向可控硅、內(nèi)置過零檢測的光電耦合器構(gòu)成的后向功率控制電路。該溫度控制系統(tǒng)采用分段PID控制算法，通過調(diào)功法用制冷片控制木箱內(nèi)溫度，能夠在5～35℃范圍內(nèi)自由設(shè)定木箱內(nèi)溫度，穩(wěn)定狀態(tài)下溫度在±1℃范圍內(nèi)波動。

工業(yè)控制
2010-09-14

FPGA 溫度自動控制系統(tǒng) BSP
基于單片機(jī)和FPGA的掃頻儀設(shè)計

以89S52單片機(jī)和FPGA為控制核心，設(shè)計了一個測試四端網(wǎng)絡(luò)幅頻特性和相頻特性的掃頻儀。系統(tǒng)功能分為掃頻信號產(chǎn)生、幅頻特性測試、相頻特性測試等模塊；而操作部分包括矩陣鍵盤、點陣式液晶顯示器、波形顯示電路。系統(tǒng)可以測量未知網(wǎng)絡(luò)特定頻率點的頻率特性，此外，用戶還可以通過鍵盤設(shè)置掃頻信號的上下限，并利用示波器精確的顯示幅頻、相頻曲線。

單片機(jī)
2010-09-14

掃頻儀基于單片機(jī) FPGA BSP
基于FPGA的雷達(dá)脈沖預(yù)分選器設(shè)計

現(xiàn)代電子戰(zhàn)環(huán)境復(fù)雜，信號密度大，所以對信號的實時分選很重要。這里，提出一種基于關(guān)聯(lián)比較器的雷達(dá)信號分選方法，在實現(xiàn)多參數(shù)分選的同時，也保證了實時性。詳細(xì)闡述了在Virtex 4系列FPGA上實現(xiàn)基于內(nèi)容可尋存儲器(CAM)的關(guān)聯(lián)比較器的途徑。

數(shù)字電源
2010-09-13

脈沖雷達(dá) FPGA BSP
基于FPGA的RFID讀寫器設(shè)計

摘要：設(shè)計并提出一種高頻射頻識別系統(tǒng)讀寫器設(shè)計的新方案。讀寫器采用MF RC500射頻讀寫芯片，以FPGA作為處理器，符合ISO／IECl4-443標(biāo)準(zhǔn)，工作頻率為13．56MHz，讀寫距離為10cm左右。給出了讀寫器硬件系統(tǒng)的組成和軟

通信技術(shù)
2010-09-13

讀寫器 RFID讀寫器 FPGA BSP
基于FPGA和SMT387的SAR數(shù)據(jù)采集與存儲系統(tǒng)

為了解決現(xiàn)有的合成孔徑雷達(dá)SAR回波信號采集存儲系統(tǒng)不能同時滿足高采樣率、高采樣精度、高存儲速度、大存儲容量、脫機(jī)運行的問題。該文提出了一種基于FPGA和DSP的SAR回波信號的采集與存儲系統(tǒng)。該系統(tǒng)采用專用于數(shù)據(jù)硬盤存儲的DSP功能模塊SMT387和ViTrex 4系列的FPGA器件XC4VFxl2設(shè)計。Virtex 4系列FPGA主要控制采集存儲系統(tǒng)的總體時序，采集回波信號的有效部分存入SATA硬盤，SMT387主要運用紐曼-皮爾遜準(zhǔn)則的滑窗檢測算法檢測回波信號的具體位置，并計算出各種位置信息的具體參數(shù)，再將這些參數(shù)傳到FPGA，控制系統(tǒng)的總體時序。該系統(tǒng)采樣率達(dá)170百萬次／秒，能夠?qū)φ粌陕沸盘柾瑫r采集，能夠脫機(jī)、長時間存儲120MB、16位的高速數(shù)據(jù)。

電子設(shè)計自動化
2010-09-13

數(shù)據(jù)采集 SAR SMT FPGA
基于FPGA的信道化接收機(jī)

針對寬帶陣列偵收系統(tǒng)，設(shè)計一種基于FPGA的信道化接收機(jī)實現(xiàn)方案，并對各模塊具體的實現(xiàn)進(jìn)行了分析、設(shè)計，特別是基于FPGA的信道化模塊。整個系統(tǒng)具有子信道頻帶窄、利于對信號進(jìn)行精細(xì)化處理、功耗低、體積小、成本低、操作靈活以及易于擴(kuò)展等特點。硬件系統(tǒng)測試結(jié)果驗證了系統(tǒng)設(shè)計的有效性和可行性。

電子設(shè)計自動化
2010-09-13

接收機(jī) 信道 FPGA BSP
FPGA進(jìn)行開發(fā)嵌入式系統(tǒng)中用的幾個發(fā)展方向

顧名思義，嵌入式系統(tǒng)指的是嵌入到系統(tǒng)內(nèi)部的計算機(jī)系統(tǒng)，是面向特定應(yīng)用設(shè)計的專用計算機(jī)系統(tǒng)?！　≡缙诘那度胧较到y(tǒng)一般是以通用處理器或單片機(jī)為核心，在外圍電路中加入存儲器、功率驅(qū)動器、通信接口、顯示接口

數(shù)字電源
2010-09-13

嵌入式系統(tǒng) 調(diào)試 ALTIUM FPGA
FPGA進(jìn)行開發(fā)嵌入式系統(tǒng)中用的幾個發(fā)展方向

FPGA進(jìn)行開發(fā)嵌入式系統(tǒng)中用的幾個發(fā)展方向

嵌入式軟件
2010-09-13

嵌入式系統(tǒng) 調(diào)試 ALTIUM FPGA
基于FPGA的圖形點陣液晶顯示模塊的應(yīng)用設(shè)計

摘要：提出了一種基于FPGA和T6963C模塊來控制液晶顯示的實現(xiàn)方法。介紹了液晶顯示控制器T6963C的性能特點，給出了FPGA與液晶顯示屏WG240128B的硬件接口電路、軟件設(shè)計流程和液晶顯示程序。關(guān)鍵詞：FPGA；圖形液晶顯

數(shù)字電源
2010-09-12

應(yīng)用設(shè)計液晶顯示模塊圖形點陣 FPGA
基于FPGA-SPARTAN芯片的CCD的硬件驅(qū)動電路設(shè)計

基于FPGA-SPARTAN芯片的CCD的硬件驅(qū)動電路設(shè)計

嵌入式教程
2010-09-12

硬件 CCD SPARTAN FPGA
基于FPGA和SMT387的SAR數(shù)據(jù)采集與存儲系統(tǒng)

為了解決現(xiàn)有的合成孔徑雷達(dá)SAR回波信號采集存儲系統(tǒng)不能同時滿足高采樣率、高采樣精度、高存儲速度、大存儲容量、脫機(jī)運行的問題。該文提出了一種基于FPGA和DSP的SAR回波信號的采集與存儲系統(tǒng)。該系統(tǒng)采用專用于數(shù)據(jù)硬盤存儲的DSP功能模塊SMT387和ViTrex 4系列的FPGA器件XC4VFxl2設(shè)計。Virtex 4系列FPGA主要控制采集存儲系統(tǒng)的總體時序，采集回波信號的有效部分存入SATA硬盤，SMT387主要運用紐曼-皮爾遜準(zhǔn)則的滑窗檢測算法檢測回波信號的具體位置，并計算出各種位置信息的具體參

數(shù)字電源
2010-09-10

數(shù)據(jù)采集 SAR SMT FPGA
MCS-51單片機(jī)與FPGA

1 單片機(jī)與FPGA的接口方式單片機(jī)與FPGA的接口方式一般有兩種，即總線方式與獨立方式。MCS-51單片機(jī)具有很強(qiáng)的外部總線擴(kuò)展能力，利用片外三總線結(jié)構(gòu)很容易實現(xiàn)單片機(jī)與FPGA的總線接口，而且單片機(jī)以總線方式與FPGA進(jìn)

單片機(jī)
2010-09-10

總線接口 MCS-51單片機(jī) FPGA BSP
基于FPGA的三相函數(shù)信號發(fā)生器設(shè)計

摘要：基于FPGA的三相函數(shù)信號發(fā)生器以DDS為核心，在Altera公司CycloneⅡ系列EP2C8T144C8上實現(xiàn)正弦波、方波、三角波和鋸齒波信號的產(chǎn)生，利用單片機(jī)PICl8F4550控制波形的頻率及相位差。同時單片機(jī)通過DAC0832控制波

電子設(shè)計自動化
2010-09-10

正弦波函數(shù)信號發(fā)生器 FPGA BSP
2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

嵌入式軟件
2010-09-08

物聯(lián)網(wǎng) 嵌入式技術(shù) FPGA BSP
2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

嵌入式軟件
2010-09-08

物聯(lián)網(wǎng) 嵌入式技術(shù) FPGA BSP
基于FPGA的圖像調(diào)焦系統(tǒng)研究

摘要：采用基于圖像技術(shù)的自動調(diào)焦方法，根據(jù)圖像分析出圖形的質(zhì)量，完成圖像預(yù)處理、清晰度判別，獲得當(dāng)前的成像狀況。通過控制電機(jī)，完成調(diào)焦操作。其中核心技術(shù)是分析圖像質(zhì)量評價函數(shù)。針對調(diào)焦算法計算量大、計

電子設(shè)計自動化
2010-09-07

系統(tǒng)研究函數(shù) FPGA BSP
基于FPGA的彩色圖像增強(qiáng)系統(tǒng)

提高顯示器的視覺效果，提出增強(qiáng)比度擴(kuò)展和色飽和度兩種算法，來對彩色圖像進(jìn)行增強(qiáng)處理，為滿足視頻信號的實時性要求，應(yīng)用FPGA構(gòu)造高速圖像處理系統(tǒng)。實驗結(jié)果表明，本方法能提高圖像的層次感，增強(qiáng)色彩飽和度，達(dá)到顯著提升視覺感受的效果。

電子設(shè)計自動化
2010-09-06

彩色圖像 RGB FPGA BSP
基于FPGA的65nm芯片的設(shè)計方案

　　隨著工藝技術(shù)向65nm以及更小尺寸的邁進(jìn)，出現(xiàn)了兩類關(guān)鍵的開發(fā)問題：待機(jī)功耗和開發(fā)成本。這兩個問題在每一新的工藝節(jié)點上都非常突出，現(xiàn)在已經(jīng)成為設(shè)計團(tuán)隊面臨的主要問題。在設(shè)計方法上從專用集成電路(ASIC)和

數(shù)字電源
2010-09-05

芯片待機(jī)功耗 65NM FPGA
基于FPGA的65nm芯片的設(shè)計方案

基于FPGA的65nm芯片的設(shè)計方案

嵌入式教程
2010-09-05

芯片待機(jī)功耗 65NM FPGA
FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

　　本文將介紹FPGA的功耗、流行的低功耗功能件以及影響功耗的用戶選擇方案，并探討近期的低功耗研究，以洞察高功率效率FPGA的未來趨勢?！　」牡慕M成部分　　FPGA的功耗由兩部分組成：動態(tài)功耗和靜態(tài)功耗。信號給

數(shù)字電源
2010-09-05

器件芯片供電 FPGA

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基于FPGA的信道化接收機(jī)

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2010年嵌入式技術(shù)全國巡回師資培訓(xùn)班

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基于FPGA的65nm芯片的設(shè)計方案

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