FPGA

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

基于FPGA的等位移多點采樣硬幣識別研究

0 引言硬幣的識別分為兩個方面：對于硬幣幣值的準確檢測；對于真幣、偽幣的準確鑒別。由于硬幣的復(fù)雜性，長期以來，對于硬幣的準確識別都難以很好的解決。目前，無論是國外還是國內(nèi)，通常的解決方法都是基于單

電子設(shè)計自動化
2009-08-24

FPGA 位移 BSP 線圈
基于FPGA的64點FFT處理器設(shè)計

0 引言 DFT作為DSP領(lǐng)域中時域和頻域轉(zhuǎn)換的基本運算，存在運算量太大的缺點，導(dǎo)致其應(yīng)用受到局限。 DFT快速算法FFT的提出，簡化了DFT的運算過程，使其在實時信號處理領(lǐng)域中得到廣泛應(yīng)用。FFT實現(xiàn)的方法包括軟件

數(shù)字電源
2009-08-23

運算器 FFT處理器 FPGA BSP
基于FPGA的神經(jīng)元自適應(yīng)PID控制器設(shè)計

引言迄今為止，PID控制器因其具有結(jié)構(gòu)簡單、容易實現(xiàn)等特點，仍是實際工業(yè)過程中廣泛采用的一種比較有效的控制方法。但當被控對象存在非線性和時變特性時，傳統(tǒng)的PID 控制器往往難以獲得滿意的控制效果。神經(jīng)網(wǎng)絡(luò)以

數(shù)字電源
2009-08-22

單神經(jīng)元控制器設(shè)計自適應(yīng)PID控制器 FPGA
一種高檔FPGA可重構(gòu)配置方法

基于軟件無線電的某機載多模式導(dǎo)航接收機能較好地解決導(dǎo)航體制不兼容對飛行保障區(qū)域的限制，但由于各體制信號差異較大，各自實現(xiàn)其硬件將相當龐大，若對本系統(tǒng)中數(shù)字信號處理的核心 FPGA芯片使用可重構(gòu)的配置方法，將

數(shù)字電源
2009-08-22

DC CONFIG FPGA BSP
一種高檔FPGA可重構(gòu)配置方法

一種高檔FPGA可重構(gòu)配置方法

嵌入式軟件
2009-08-22

DC CONFIG FPGA BSP
基于FPGA的AES算法芯片設(shè)計實現(xiàn)

引言密碼模塊作為安全保密系統(tǒng)的重要組成部分，其核心任務(wù)就是加密數(shù)據(jù)。分組密碼算法AES以其高效率、低開銷、實現(xiàn)簡單等特點目前被廣泛應(yīng)用于密碼模塊的研制中。密碼模塊一般被設(shè)計成外接在主機串口或并口的一個硬件

電子設(shè)計自動化
2009-08-21

芯片設(shè)計 PROCESS AES算法 FPGA
基于FPGA的芯片設(shè)計及其應(yīng)用

過去，半導(dǎo)體行業(yè)一直關(guān)注的兩個目標是縮小體積和提高速率。近 40年來，對這些目標的追求促使行業(yè)發(fā)展符合摩爾定律，性能和電路密度每18個月翻倍。導(dǎo)致技術(shù)高速發(fā)展，蘊育了計算機革命、互聯(lián)網(wǎng)革命以及現(xiàn)在的無線通信

電子設(shè)計自動化
2009-08-21

Xilinx 芯片設(shè)計 ASIC設(shè)計 FPGA
一種基于FPGA的誤碼性能測試方案

在數(shù)字通信系統(tǒng)的性能測試中,通常使用誤碼分析儀對其誤碼性能進行測量。它雖然具有簡單易用、測試內(nèi)容豐富、誤碼測試結(jié)果直觀、準確等優(yōu)點,但是,價格昂貴、不易與某些系統(tǒng)接口適配,通常需要另加外部輔助長線驅(qū)動電路

模擬
2009-08-21

測試方案移位寄存器 M序列發(fā)生器 FPGA
FPGA：65nm器件上量低功耗市場興起

隨著65nm工藝的應(yīng)用以及更多低功耗技術(shù)的采用，F(xiàn)PGA擁有了更低的成本、更高的性能以及突破性的低耗電量，具備進入更廣泛市場的條件。FPGA從業(yè)者表示，今年FPGA快速增長，而預(yù)計明年仍將是一個增長年。比拼65nm器件加

電子設(shè)計自動化
2009-08-20

器件低功耗 65NM FPGA
NI LabVIEW 2009滿足測試應(yīng)用複雜開發(fā)需求

美商國家儀器（NI）近日全新發(fā)表LabVIEW 2009，為最新版的圖形化系統(tǒng)設(shè)計（GSD）平臺，適用於測試、控制，與嵌入式系統(tǒng)的開發(fā)。LabVIEW 2009新工具可針對重要測試軟體的開發(fā)、佈署，與維護作業(yè)，簡化測試系統(tǒng)的複雜開

模擬
2009-08-19

WLAN LabVIEW NI FPGA
FPGA配合預(yù)失真技術(shù)的解調(diào)誤碼測試儀

1 引言工程實踐中，我們往往需要對所設(shè)計的硬件電路進行設(shè)計檢驗以保證其正常運作，從而才能進一步支持基于該硬件的復(fù)雜程序的正確調(diào)試。這樣，特定的相應(yīng)測試系統(tǒng)設(shè)計就顯得尤為重要，不僅可以保證硬件的健康度，更

模擬
2009-08-19

解調(diào) 誤碼測試儀 QPSK FPGA
基于FPGA的AES算法芯片設(shè)計實現(xiàn)

引言密碼模塊作為安全保密系統(tǒng)的重要組成部分，其核心任務(wù)就是加密數(shù)據(jù)。分組密碼算法AES以其高效率、低開銷、實現(xiàn)簡單等特點目前被廣泛應(yīng)用于密碼模塊的研制中。密碼模塊一般被設(shè)計成外接在主機串口或并口的一個硬件

數(shù)字電源
2009-08-19

芯片設(shè)計 PROCESS AES算法 FPGA
流水線技術(shù)在基于FPGA的DSP運算中的應(yīng)用研究

流水線技術(shù)是FPGA設(shè)計速度優(yōu)化的有效方法之一。通過不同流水線級數(shù)和不同位寬的加法器和乘法器綜合數(shù)據(jù)的對比，說明在用FPGA實現(xiàn)數(shù)字信號處理硬件化運算中流水線技術(shù)的有效性和選擇方法。對流水線應(yīng)用中設(shè)計方法的選擇、流水線首次延時和寄存器觸發(fā)時間、嵌入式存儲器塊的使用、控制流水線和數(shù)據(jù)流水線的劃分等需要注意的關(guān)鍵問題進行了簡要分析。

模擬
2009-08-18

DSP 寄存器 FPGA BSP
9月19日Android/WinCE/FPGA講座

9月19日Android/WinCE/FPGA講座

嵌入式軟件
2009-08-16

Windows WinCE Android FPGA
9月19日Android/WinCE/FPGA講座

9月19日Android/WinCE/FPGA講座

嵌入式軟件
2009-08-16

Windows WinCE Android FPGA
9月19日Android/WinCE/FPGA講座

9月19日Android/WinCE/FPGA講座

嵌入式軟件
2009-08-16

Windows WinCE Android FPGA
流水線技術(shù)在基于FPGA的DSP運算中的應(yīng)用研究

流水線技術(shù)是FPGA設(shè)計速度優(yōu)化的有效方法之一。通過不同流水線級數(shù)和不同位寬的加法器和乘法器綜合數(shù)據(jù)的對比，說明在用FPGA實現(xiàn)數(shù)字信號處理硬件化運算中流水線技術(shù)的有效性和選擇方法。對流水線應(yīng)用中設(shè)計方法的選擇、流水線首次延時和寄存器觸發(fā)時間、嵌入式存儲器塊的使用、控制流水線和數(shù)據(jù)流水線的劃分等需要注意的關(guān)鍵問題進行了簡要分析。

數(shù)字電源
2009-08-15

DSP 寄存器 FPGA BSP

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基于FPGA的64點FFT處理器設(shè)計

基于FPGA的神經(jīng)元自適應(yīng)PID控制器設(shè)計

一種高檔FPGA可重構(gòu)配置方法

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基于FPGA的AES算法芯片設(shè)計實現(xiàn)

基于FPGA的芯片設(shè)計及其應(yīng)用

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NI LabVIEW 2009滿足測試應(yīng)用複雜開發(fā)需求

FPGA配合預(yù)失真技術(shù)的解調(diào)誤碼測試儀

基于FPGA的AES算法芯片設(shè)計實現(xiàn)

流水線技術(shù)在基于FPGA的DSP運算中的應(yīng)用研究

9月19日Android/WinCE/FPGA講座

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