FPGA

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。

用于AT91CAP9H的200萬門開發(fā)工具包(Atmel)

用于AT91CAP9H的200萬門開發(fā)工具包(Atmel)

嵌入式動(dòng)態(tài)
2009-03-17

Atmel AT91 開發(fā)工具包 FPGA
基于FPGA的HDB3編解碼器設(shè)計(jì)

基于FPGA的HDB3編解碼器設(shè)計(jì)

嵌入式教程
2009-03-14

編解碼器 HD BSP FPGA
招人雜談

招人雜談

嵌入式軟件
2009-03-14

操作系統(tǒng) ARM 電子工程師 FPGA
招人雜談

招人雜談

嵌入式軟件
2009-03-14

操作系統(tǒng) ARM 電子工程師 FPGA
基于FPGA的A/D轉(zhuǎn)換采樣控制模塊的設(shè)計(jì)

摘要：本文采用FPGA器件EP1C6T144C8芯片代替單片機(jī)控制A/D轉(zhuǎn)換芯片ADC0809進(jìn)行采樣控制，整個(gè)設(shè)計(jì)用VHDL語言描述，在QuartusⅡ平臺(tái)下進(jìn)行軟件編程實(shí)現(xiàn)正確的A/D轉(zhuǎn)換的工作時(shí)序控制過程，并將采樣數(shù)據(jù)從二進(jìn)制轉(zhuǎn)化成B

電子設(shè)計(jì)自動(dòng)化
2009-03-13

控制模塊采樣控制 A/D轉(zhuǎn)換 FPGA
頻率特性測(cè)試儀的設(shè)計(jì)

以89C51單片機(jī)和FPGA構(gòu)成的最小系統(tǒng)為核心，實(shí)現(xiàn)了一定頻帶范圍內(nèi)對(duì)一個(gè)未知四端網(wǎng)絡(luò)的幅頻特性和相頻特性的測(cè)量。該系統(tǒng)由掃頻信號(hào)發(fā)生器，幅度測(cè)量模塊，相位測(cè)量模塊，示波器顯示模塊等構(gòu)成。用數(shù)字頻率合成技術(shù)設(shè)計(jì)掃頻信號(hào)發(fā)生器。用戶通過按鍵測(cè)量特定頻率的頻率特性。掃頻測(cè)量時(shí)，可以選擇掃頻輸出信號(hào)的下限和上限以及步進(jìn)值。示波器顯示出幅頻和相頻的曲線，界面友好。

測(cè)試測(cè)量
2009-03-13

相位差頻率特性測(cè)試儀 BSP FPGA
一種寬帶復(fù)接器的設(shè)計(jì)與實(shí)現(xiàn)

信息時(shí)代的到來使人們需要共享越來越多的信息。隨著信息及其需求的爆炸性增長(zhǎng),信息的選擇及傳輸速率成為一個(gè)重要問題。有線電視網(wǎng)絡(luò)有其固有的高帶寬特性,適合大容量的數(shù)據(jù)傳輸和實(shí)時(shí)性要求,使寬帶數(shù)字接入成為可能。

通信技術(shù)
2009-03-11

DSP 寬帶 BSP FPGA
基于單片機(jī)和FPGA的頻率特,tt測(cè)試儀

介紹基于89S51單片機(jī)和FPGA的頻率特性測(cè)試儀的設(shè)計(jì)。該系統(tǒng)設(shè)計(jì)利用DDS原理由FPGA經(jīng)D／A轉(zhuǎn)換產(chǎn)生掃頻信號(hào)，再經(jīng)待測(cè)網(wǎng)絡(luò)實(shí)現(xiàn)峰值檢測(cè)和相位檢測(cè)，從而完成了待測(cè)網(wǎng)絡(luò)幅頻和相頻特性曲線的測(cè)量和顯示。經(jīng)過調(diào)試，示波器顯示待測(cè)網(wǎng)絡(luò)頻率范圍100 Hz～100 kHz的幅頻和相頻特性曲線，該系統(tǒng)工作穩(wěn)定，操作方便。

單片機(jī)
2009-03-11

測(cè)試儀 BSP 基于單片機(jī) FPGA
基于FPGA的A/D轉(zhuǎn)換采樣控制模塊的設(shè)計(jì)

摘要：本文采用FPGA器件EP1C6T144C8芯片代替單片機(jī)控制A/D轉(zhuǎn)換芯片ADC0809進(jìn)行采樣控制，整個(gè)設(shè)計(jì)用VHDL語言描述，在QuartusⅡ平臺(tái)下進(jìn)行軟件編程實(shí)現(xiàn)正確的A/D轉(zhuǎn)換的工作時(shí)序控制過程，并將采樣數(shù)據(jù)從二進(jìn)制轉(zhuǎn)化成B

數(shù)字電源
2009-03-11

控制模塊采樣控制 A/D轉(zhuǎn)換 FPGA
基于FPGA 的簡(jiǎn)化UART 電路設(shè)計(jì)

摘要：本文闡述了通用異步發(fā)生器UART 的功能特點(diǎn)，介紹了用硬件描述語言Verilog 來開發(fā)各個(gè)模塊，并給出仿真結(jié)果。本設(shè)計(jì)使用Altera 的FPGA 芯片，將UART 的核心功能嵌入到FPGA 內(nèi)部，能夠?qū)崿F(xiàn)異步通信的功能，可以

電子設(shè)計(jì)自動(dòng)化
2009-03-10

電路設(shè)計(jì) UART BSP FPGA
測(cè)試檢驗(yàn)電路時(shí)序的FPGA邏輯驗(yàn)證分析儀

隨著FPGA技術(shù)的廣泛使用，越來越需要一臺(tái)能夠測(cè)試驗(yàn)證FPGA芯片中所下載電路邏輯時(shí)序是否正確的儀器。目前，雖然Agilent、Tektronix 等大公司生產(chǎn)的高端邏輯分析儀能夠?qū)崿F(xiàn)FPGA電路的測(cè)試驗(yàn)證功能，但此類儀器價(jià)格

電子設(shè)計(jì)自動(dòng)化
2009-03-10

電路時(shí)序 BSP FPGA
基于FPGA的線陣CCD驅(qū)動(dòng)時(shí)序及模擬信號(hào)處理的設(shè)計(jì)

為保證線陣CCD在圖像測(cè)量中正常、穩(wěn)定工作，必須設(shè)計(jì)出適合其工作的時(shí)序驅(qū)動(dòng)電路。在分析TCDl501D線陣CCD驅(qū)動(dòng)時(shí)序關(guān)系的基礎(chǔ)上，通過分析CCD輸出的圖像信號(hào)，給出了內(nèi)、外相關(guān)雙采樣的時(shí)序控制。最后，利用quanus7．2軟件平臺(tái)結(jié)合VHDL語言進(jìn)行開發(fā)，對(duì)所需驅(qū)動(dòng)脈沖進(jìn)行仿真設(shè)計(jì)。仿真結(jié)果表明，該驅(qū)動(dòng)電路簡(jiǎn)單、功耗小、成本低、抗干擾能力強(qiáng)，適用于設(shè)備小型化的要求。

電子設(shè)計(jì)自動(dòng)化
2009-03-10

模擬信號(hào) 時(shí)序信號(hào)處理 FPGA
基于FPGA的全數(shù)字鎖相環(huán)的設(shè)計(jì)

簡(jiǎn)單介紹了全數(shù)字鎖相環(huán)(ADPLL)的結(jié)構(gòu)和工作原理，提出一種在FPGA的基礎(chǔ)上可增大全數(shù)字鎖相環(huán)同步范圍的設(shè)計(jì)方法，并給出了部分verilog HDL設(shè)計(jì)程序的代碼和仿真波形。

電子設(shè)計(jì)自動(dòng)化
2009-03-10

全數(shù)字鎖相環(huán) PLL BSP FPGA
Altera Stratix IV FPGA榮獲《今日電子》年度產(chǎn)品獎(jiǎng)

Altera公司宣布，其40-nm Stratix IV FPGA系列榮獲《今日電子》雜志頒發(fā)的“年度產(chǎn)品獎(jiǎng)”。Stratix IV器件系列自從2008年3月發(fā)布以來，這已是第六次獲獎(jiǎng)?！督袢针娮印返摹澳甓犬a(chǎn)品獎(jiǎng)”每年評(píng)選一次，頒發(fā)給在技術(shù)和

電子設(shè)計(jì)自動(dòng)化
2009-03-10

電子 Altera STRATIX FPGA
基于FPGA的RS編碼器的設(shè)計(jì)與實(shí)現(xiàn)

RS碼是線性分組碼中一種典型的糾錯(cuò)碼，既能糾正隨機(jī)錯(cuò)誤，也能糾正突發(fā)錯(cuò)誤，在現(xiàn)代通信領(lǐng)域越來越受到重視。文中介紹基于FPGA使用Verilog—HDL語言的RS(15，9)編碼器的設(shè)計(jì)方法，并在QuartusII 5．O軟件環(huán)境下進(jìn)行了功能仿真，仿真結(jié)果與理論分析相一致，該設(shè)計(jì)方法對(duì)實(shí)現(xiàn)任意長(zhǎng)度的RS編碼有重要參考價(jià)值。

電子設(shè)計(jì)自動(dòng)化
2009-03-09

編碼器 BSP RS編碼 FPGA

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